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基于Quartus Ⅱ软件实现16位CPU的设计方案
基于Quartus Ⅱ软件实现16位CPU的设计方案
上传者:
38502183
|
上传时间: 2021-12-28 15:08:36
|
文件大小: 358KB
|
文件类型: -
QUARTUS
Ⅱ
FPGA/CPLD
CPU
CPU是广泛使用的串行数据通讯电路。本设计包含发送器、接收器和波特率发生器。设计应用EDA技术,基于FPGA/CPLD器件设计与实现CPU。本文利用Quartus Ⅱ软件仿真环境,基于FPGA(现场可编程门阵列)/CPLD(复杂可编程逻辑器件)设计与实现16位CPU的设计方案。
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