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基于Verilog
_HDL的高效状态机设计
基于Verilog
_HDL的高效状态机设计,描述了有限状态机设计的几种设计方法,分析了影响状态机设计时延、速度和电路综合面积问题,提出了一种高效状态机设计方法
2024-03-21 19:59:47
213KB
Verilog_HD
1
基于Verilog
语言的自动售货机的设计
(1)设计一个自动售货机,能够提供4种不同价格的货物; (2)要求投币金额的面额数至少为2种以上(5元,10元等); (3)在交易过程中,如果投币金额高于所购买商品的价格,则交易成功,售货机出货,并可以选择找零或者继续购买;若投币金额低于购买商品的价格,则提示购买金额不足; (4)整个交易流程使用LED灯对各阶段进行描述(出货指示灯、交易成功指示灯等)。(20分)
2024-03-14 15:57:06
824KB
编程语言
1
基于Verilog
_HDL的UART串行通讯模块设计及仿真
基于Verilog
_HDL的UART串行通讯模块设计及仿真串行接口是连接FPGA和PC机的一种简单方式。这个项目向大家展示了如果使用FPGA来创建RS-232收发器。
2024-01-16 02:19:44
996KB
UART
串行通讯
1
基于verilog
的TCM网格编码
基于FPGA的TCM网格编码的verilog代码实现
2023-06-24 20:13:06
12KB
TCM
1
基于verilog
编程实现的2048点FFT实现不使用IP核,
基于verilog
编程实现的2048点FFT实现不使用IP核,
2023-04-22 21:30:11
65KB
tcp/ip
综合资源
fpga开发
网络协议
基于verilog
HDL 的8051 IP核开发
Verilog HDL (Hardware Description Language) 是一种硬件描述语言,可以在算法级、门级到开关级的多种抽象设计层次上对数字系统建模。它可以描述设计的行为特性、数据流特性、结构组成以及包含响应监控和设计验证方面的时延和波形产生机制。次例程是
基于verilog
HDL 的8051 IP核开发,很好的学习资料。
2023-04-06 15:59:19
298KB
verilog
8051
mcu
单片机
1
基于Verilog
的GMSK的调制解调
使用FPGA实现GMSK调制解调代码
2023-03-22 19:24:52
404KB
GMSK
FPGA
Verilog
调制解调
1
基于Verilog
的数字频率计
通过计算单位时间内脉冲信号的个
2023-03-06 08:52:45
3KB
频率计
1
基于verilog
的LCD12864的显示器设计
基于verilog
的LCD12864的显示器设计
2023-03-02 17:38:02
3.65MB
LCD
verilog
FPGA
1
FPGA实训
基于verilog
的VGA简单接口驱动
FPGA的例程,
基于verilog
的VGA简单接口驱动,很有帮助
2023-02-21 10:20:11
1.55MB
FPGA
verilog
1
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