懂得都懂 第1关MIPS指令译码器设计 第2关定长指令周期---时序发生器FSM设计 第3关定长指令周期---时序发生器输出函数设计 第4关硬布线控制器组合逻辑单元 第5关定长指令周期---硬布线控制器设计 第6关定长指令周期---单总线CPU设计 logisim实验电路图，可查看电路，可提交代码 欢迎各位小伙伴前来下载。

码上即通关，快来试试！

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仅是通过头歌测试的完成文件（MipsOnBusCpu-3.circ）6关全部满分通过测试，无其他内容~ MIPS指令译码器设计|变长指令周期---时序发生器FSM设计|变长指令周期---时序发生器输出函数设计|硬布线控制器组合逻辑单元|变长指令周期---硬布线控制器设计|变长指令周期---单总线CPU设计 学习交流q2267261634

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所有关卡， 头歌秒过 MipsOnBusCpu-3

百分之百全过 单独一个 circ文件

时钟周期：     时钟周期也称为振荡周期，定义为时钟脉冲的倒数(可以这样来理解，时钟周期就是单片机外接晶振的倒数，例如12M的晶振，它的时间周期就是1/12us)，是计算机中最基本的、最小的时间单位。     在一个时钟周期内，CPU仅完成一个最基本的动作。对于某种单片机，若采用了1MHZ的时钟频率，则时钟周期为1us;若采用4MHZ的时钟频率，则时钟周期为250us。由于时钟脉冲是计算机的基本工作脉冲，它控制着计算机的工作节奏(使计算机的每一步都统一到它的步调上来)。显然，对同一种机型的计算机，时钟频率越高，计算机的工作速度就越快。具体计算就是1/fosc。也就是说如果晶振为1MHz，

单总线CPU设计(定长指令周期3级时序) MIPS指令译码器设计 定长指令周期---时序发生器FSM设计 定长指令周期---时序发生器输出函数设计

计算机组成原理头歌平台上的，闯关都闯完了，不知道能不能运行，反正头歌都能过。