头歌之计算机组成原理之单总线CPU设计(定长指令周期3级时序)(HUST)实验运行代码

上传者: qwertyuiop323737 | 上传时间: 2025-11-27 08:51:53 | 文件大小: 152KB | 文件类型: RAR
其中的内容分别为: 第1关:MIPS指令译码器设计 第2关:定长指令周期---时序发生器FSM设计 第3关:定长指令周期---时序发生器输出函数设计 第4关:硬布线控制器组合逻辑单元 第5关:定长指令周期---硬布线控制器设计 第6关:定长指令周期---单总线CPU设计

文件下载

资源详情

[{"title":"( 6 个子文件 152KB ) 头歌之计算机组成原理之单总线CPU设计(定长指令周期3级时序)(HUST)实验运行代码","children":[{"title":"单总线CPU设计(定长指令周期3级时序)(HUST)","children":[{"title":"定长指令周期---单总线CPU设计.txt <span style='color:#111;'> 465.69KB </span>","children":null,"spread":false},{"title":"定长指令周期---硬布线控制器设计.txt <span style='color:#111;'> 465.69KB </span>","children":null,"spread":false},{"title":"MIPS指令译码器设计.txt <span style='color:#111;'> 465.69KB </span>","children":null,"spread":false},{"title":"硬布线控制器组合逻辑单元.txt <span style='color:#111;'> 465.69KB </span>","children":null,"spread":false},{"title":"定长指令周期---时序发生器FSM设计.txt <span style='color:#111;'> 465.69KB </span>","children":null,"spread":false},{"title":"定长指令周期---时序发生器输出函数设计.txt <span style='color:#111;'> 465.69KB </span>","children":null,"spread":false}],"spread":true}],"spread":true}]

评论信息

免责申明

【只为小站】的资源来自网友分享,仅供学习研究,请务必在下载后24小时内给予删除,不得用于其他任何用途,否则后果自负。基于互联网的特殊性,【只为小站】 无法对用户传输的作品、信息、内容的权属或合法性、合规性、真实性、科学性、完整权、有效性等进行实质审查;无论 【只为小站】 经营者是否已进行审查,用户均应自行承担因其传输的作品、信息、内容而可能或已经产生的侵权或权属纠纷等法律责任。
本站所有资源不代表本站的观点或立场,基于网友分享,根据中国法律《信息网络传播权保护条例》第二十二条之规定,若资源存在侵权或相关问题请联系本站客服人员,zhiweidada#qq.com,请把#换成@,本站将给予最大的支持与配合,做到及时反馈和处理。关于更多版权及免责申明参见 版权及免责申明