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FPGA实验.docx

七段显示译码器 8位硬件加法器七人表决器巴克码多功能数字时钟状态机 verilogHDL语言，全部编译通过，并在实验箱验证过

2022-11-23 11:48:54 15.1MB FPGA Verilog

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基于FPGA实现点阵显示

基于FPGA实现点阵显示使用FPGA的原理图来实现，是基于Xinlinx公司的EP1C3T144C8,已验证成功

2022-11-23 10:47:08 209KB FPGA 点阵显示

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FPGA Synthesis Training Course 台湾晶片系统设计中心培训课程

台湾晶片系统设计中心培训课程，非常好的入门教材。华为推荐教材。

2022-11-22 21:22:05 1.62MB FPGA Synthesis

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8_pipeline_cpu.zip

可供借鉴和使用的CPU流水线8 包括源代码.v文件和工程所有文件第一次分享资源所以只要很少的积分（意思意思）可以供想学习FPGA或者在学数字逻辑、计算机组成原理和计算机系统结构的人学习如果是做计算机系统实验也可以直接拿去用

2022-11-22 20:36:21 1.42MB fpga cpu

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基于LabVIEW和FPGA的虚拟逻辑分析仪设计与测试-论文

基于LabVIEW和FPGA的虚拟逻辑分析仪设计与测试

2022-11-22 20:17:53 2.7MB 基于 LabVIEW fpga 虚拟逻辑分析仪

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FPGA的LVDS介绍和xilinx原语的使用方法中文说明1

1）FPGA 开发实用教程第 4 节 Xilinx 公司原语的使用方法2）ISE 的 Help—sofeware Manuals差分 I/O 端口组件IBUF

2022-11-22 20:17:45 981KB fpga开发

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基于FPGA的可调数字钟设计

2022-11-22 20:14:23 239.51MB fpga

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基于FPGA的LVDS高速数据通信卡

介绍了基于FPGA和PCI9054的LVDS数据通信卡的设计，通过FPGA实现了LVDS数据的接收发送控制、PCI9054实现了与上位机的数据交互，实现了10～200 Mbit·s-1速率的LVDS数据接收以及10～50 Mbit·s-1任意速率的LVDS数据发送。此板卡的设计，可以有效地应用于某遥测模拟信号源，并对待测设备的LVDS总线协议进行全面测试。

2022-11-22 20:08:17 281KB FPGA

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在FPGA使用Karatsuba算法实现双精度浮点乘法

双精度浮点运算广泛应用于数值计算和信号处理中，在 IEEE754 标准中实现两个双精度浮点乘法需要一个 53 bit × 53 bit 的尾数乘法器，这样的一个乘法器若采用 FPGA 实现需要大量的硬件资源。将 Karatsuba 算法应用于浮点运算器中，采用 FPGA 实现了一个浮点乘法器，与传统方法相比该乘法器占用硬件资源较少。

2022-11-22 18:20:00 690KB Karatsuba算法 FPGA

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Xilinx-FPGA-引脚功能详细介绍.doc

Xilinx-FPGA-引脚功能详细介绍,做xilinx FPGA设计的朋友可以下载参考

2022-11-22 15:13:53 293KB FPGA

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