目录 概述..................................................................................... 1 1.1 Cadence 概述................................................................................1 1.2 ASIC 设计流程.............................................................................1 第一章Cadence 使用基础................................................ 5 2.1 Cadence 软件的环境设置............................................................5 2.2 Cadence 软件的启动方法........................................................... 10 2.3 库文件的管理............................................................................. 12 2.4 文件格式的转化......................................................................... 13 2.5 怎样使用在线帮助..................................................................... 13 2.6 本手册的组成............................................................................ 14 第二章Verilog-XL 的介绍............................................. 15 3. 1 环境设置................................................................................... 15 3.2 Verilog-XL 的启动...................................................................... 15 3.3 Verilog XL 的界面................................................................... 17 3.4 Verilog-XL 的使用示例.............................................................. 18 3.5 Verilog-XL 的有关帮助文件....................................................... 19 第四章 电路图设计及电路模拟........................................ 21 4.1 电路图设计工具Composer ........................................................ 21 4.1.1 设置.................................................................................. 21 4.1.2 启动.................................................................................. 22 4.1.3 用户界面及使用方法........................................................ 22 4.1.4 使用示例........................................................................... 24 4.1.5 相关在线帮助文档............................................................ 24 4.2 电路模拟工具Analog Artist ...................................................... 24 4.2.1 设置.................................................................................. 24 4.2.2 启动.................................................................................. 25 4.2.3 用户界面及使用方法........................................................ 25 4.2.5 相关在线帮助文档............................................................ 25 第五章 自动布局布线....................................................... 27 5.1 Cadence 中的自动布局布线流程................................................ 27 5.2 用AutoAbgen 进行自动布局布线库设计................................... 28 第六章版图设计及其验证.............................................. 30 6.1 版图设计大师Virtuoso Layout Editor ........................................ 30 6.1.1 设置.................................................................................. 30 6.1.2 启动.................................................................................. 30 6.1.3 用户界面及使用方法........................................................ 31 6.1.4 使用示例........................................................................... 31 6.1.5 相关在线帮助文档............................................................ 32 6.2 版图验证工具Dracula ............................................................... 32 6.2.1 Dracula 使用介绍............................................................... 32 6.2.2 相关在线帮助文档............................................................ 33 第七章 skill 语言程序设计............................................... 34 7.1 skill 语言概述............................................................................. 34 7.2 skill 语言的基本语法.................................................................. 34 7.3 Skill 语言的编程环境................................................................. 34 7.4 面向工具的skill 语言编程......................................................... 35 附录1 技术文件及显示文件示例..................................... 60 附录2 Verilog-XL 实例文件.............................................. 72 1 Test_memory.v....................................................................... 72 2 SRAM256X8.v ...................................................................... 73 3 ram_sy1s_8052 ...................................................................... 79 4 TSMC 库文件........................................................................ 84 附录3 Dracula 命令文件.................................................3
2023-02-15 11:16:46 1.22MB Cadence vhdl 原理图 pcb
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使用现场可编程门阵列来实现了反正切函数,使用16次迭代的cordic算法来实现三角函数,有一定的误差,如果想把精度提高,自己可以加多迭代次数
2023-02-15 11:10:32 9KB FPGA
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根据伪 随机噪声 IPN)序列的相关特性 ,介绍一种 OFDM 系统中在时域利用 PN序列的循环相 关对信道进行 估计的算法 ,并利用周期序列的循环卷积特性对接收数据进行频域均衡 。最后列出其 FPGA设计流程和仿真图形。
2023-02-15 10:50:47 185KB OFDM 信道估计 FPGA
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基于FPGA的2PSK调制与解调设计.仿真
2023-02-14 21:00:43 62.04MB fpga
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基于FPGA的数字电子时钟,采用verilog语言编写,引脚已经设置好,直接运行上传即可使用。本文是用verilog语言来描述一个基于FPGA的多功能数字电子时钟的设计,该设计具备时间显示,准确计时,时间校准, 定时闹钟等功能。本文首先介绍了需要完成的工作,然后介绍了系统整体设计以及源代码开发过程。源代码首先在Quartus软件上进行仿真、综合,通过后下载到正点原子新启点开发板上,在FPGA器件上的试验结果表明上述功能全部正确,工作稳定良好。 1、能够用数码管或液晶屏显示时、分和秒(采用24小时进制); 2、具有按键校时功能,对小时和分单独校时,对分校时时,停止向小时进位; 3、具有闹钟功能,闹钟铃声为自主设计的用蜂鸣器发出的声音; 4、通过按键设置闹钟功能,且自动停闹和手动操作停闹; 5、其它创意设计:增加闹钟模式开启指示灯和闹铃提示灯;可以作为秒表使用。
2023-02-14 19:42:52 8.91MB fpga FPGA开发 verilog 课程设计
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NetFPGA-1G-CML: Kintex-7 FPGA开发板 用户手册.pdf
2023-02-14 19:22:15 1.11MB Kintex-7 FPGA NetFPGA-1G-CML
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为了充分利用USB2.0的带宽,解决数据传输时存在的速度瓶颈问题,提出了一种基于CY7C68013A的USB2.0高速接口设计方法。采用CY7C68013A的SLAVE FIFO工作模式,芯片内部CPU不参与数据传输,FPGA设计的外部控制电路直接读写芯片内部FIFO,有效避免了内部CPU参与数据传输时带来的时间开销,从而提高了传输速度。
2023-02-14 19:19:59 221KB FPGA
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a) 并采用门级编程,实现4-bit无符号整数到浮点数转换; b) 并采用RTL级编程,实现4-bit无符号整数到浮点数转换; c) 分别对门级编程实现和RTL级编程实现的组合逻辑电路进行功能仿真; d) 利用“实验板”对两种4-bit无符号整数到浮点数转换电路进行综合和实现,设定定点数输入和浮点数输出的人机接口,建议用4个LED灯表示输入值,操作开关或按动按钮后进行转换,用数码管显示有效位和幂指数;(任何合理的人机接口都是可以接受的)
2023-02-14 16:50:24 4.63MB FPGA verilo 数字电路
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红外线控制RGB三叶草灯功能概述: 红外线三叶草灯采用stc15f104w单片机为主控芯片,通过红外线遥控,控制RGB灯变色。 红外线控制RGB三叶草灯电路原理: 原理分为两部分,第一通过红外线一体化接收头接受红外线码,解码后存放在内存中;第二是通过pwm波控制RGB三色灯的颜色。 设计目的: 1.熟悉单片机外部中断,定时器的使用; 2.熟练掌握pwm控制; 3.掌握用altium designer画电路原理图和pcb板; 4.手工制版增强动手能力。 四、材料: 名称数量 stc15f104w1 红外线一体化接收头1 RGB三色灯3 Micro接头1 104贴片电容1 4.7k贴片电阻3 60贴片电阻3 8050贴片三极管3 5*5cm双面覆铜板1 STC15F104W对红外线信号解码,控制RGB彩灯颜色。
2023-02-14 15:45:14 5.01MB 红外控制 diy制作 rgb彩灯 pwm波控制
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ug_altremote的中文手册,适合学习使用哦。
2023-02-14 13:54:36 698KB FPGA
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