锁相环(PLL)电路存在于各种高频应用中，从简单的时钟净化电路到用于高性能无线电通信链路的本振(LO)，以及矢量网络分析仪(VNA)中的超快开关频率合成器。
参考上述各种应用来介绍PLL电路的一些构建模块，以指导器件选择和每种不同应用内部的权衡考虑，这对新手和PLL专家均有帮助。并且在文中参考了ADI公司的ADF4xxx和HMCxxx系列PLL和压控振荡器(VCO)，并使用ADIsimPLL（ADI公司内部PLL电路仿真器）来演示不同电路性能参数。
2023-03-01 18:53:26
150KB
1
用STM32F103采用SPI的方式实现与ADF4351的通信 ，实现锁相环芯片的控制
2023-02-23 09:38:08
2.92MB
附件是数字PLL的MATLAB仿真源码，可以仿真BPSK、QPSK的DPLL 附件是数字PLL的MATLAB仿真源码，可以仿真BPSK、QPSK的DPLL
2023-02-17 16:09:51
1KB
1
SOGI-PLL模型，其基本结构由自适应滤波器和传统PLL构成。SOGI-PLL需要注意的关键参数有：输入信号v，自适应滤波器输出的正交信号v^'和qv^'，Park变换的输出信号v_d和v_q，PD模块输出的控制信号v_f，输出信号的频率w^'和相角θ^'。
2023-02-06 22:21:06
24KB
1
也许你也会跟我一样认为典型数据表中的某些规格难以理解，这是因为其中涵盖了一些你不太熟悉的隐含惯例。对许多RF系统工程师而言，其中一种规格便是锁相环（PLL）中的相位噪声。
2023-01-29 16:00:59
111KB
1
应用电荷泵锁相环系统的等效噪声模型,分析电荷泵锁相环相位噪声在不同频率段的功率谱密度。据此得到相位噪声的功率谱密度与频率关系的模拟曲线。分析与模拟的结论指出环路噪声具有低通特性,而VCO噪声在低频区衰减明显,在设计锁相环路时需要综合考虑环路和VCO两种噪声的影响,然后才能确定环路带宽。该结论对于电荷泵锁相环的相位噪声与环路带宽设计具有一定的参考意义。
2023-01-20 15:52:41
69KB
1