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quartus分频模块

分频器系统模块将50mhz将至5kha，50hz

2019-12-24 03:27:25 259KB quartus

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16*16led文字显示

16*16led文字移动显示，已上板实验，可修改为自己想要文字，移动速度方向等都可修改，如有问题欢迎提问。

2019-12-23 03:32:42 6.17MB verilog quartus 16*16led

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计算结构CPU设计 verilog

自己写的代码，通过验收和后期的考试；注释清楚，可扩展性强，方便的添加指令； cpu架构绝对一级棒。

2019-12-22 20:10:10 369KB cpu verilog quartus 东南大学

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4位和8位，8运算，QUARTUS简易处理器

4位和8位，8运算，QUARTUS简易处理器，能在Quartus运行。。

2019-12-21 22:26:12 6.26MB QUARTUS

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quartus 9.0 64位完美破解

quartus 9.0 64位完美破解，内有使用教程，完美破解64位quartus ii 9.0

2019-12-21 22:25:22 1.51MB quartus 9.0 64位

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自己用VHDL编写的8*16点阵贪吃蛇源代码

初学VHDL在完成作业后心血来潮编写的贪吃蛇小程序，完全只使用最基本的语法，在学校机房试验箱上的altera flex10k 上使用一个8*16的led点阵进行了验证。有非随机的食物，蛇每吃3个食物张长并加速，游戏结束或没有进行则全部led均点亮……

2019-12-21 22:23:58 1.81MB VHDL Quartus altera flex10k

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整理版 quartusVHDL modelsim 实例仿真代码

内容有VHDL语法总结及相应的实例应用，每个程序我都亲自试过，特别适合初学VHDL的同学们。常用的程序有设计一个M序列发生器，M序列为“11110101”、设计一个彩灯控制器，彩灯共有16个，每次顺序点亮相邻的四个彩灯，如此循环执行，循环的方向可以控制。设计一个跑马灯控制器。一共有8个彩灯，编号为LED0~LED7，点亮方式为：先从左往右顺序点亮，然后从右往左，如此循环往复等等。这些都是我在考试前熬夜总结的，很有用。如果配合开发板用的话，那就更好了

2019-12-21 22:23:36 91KB VHDL quartus modelsim

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Quartus verilog HDL语言实现qpsk的仿真

Quartus verilog HDL语言来实现qpsk的仿真，可运行，编译，下载。

2019-12-21 22:23:34 3KB quartus verilog qpsk 代码

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verilog hdl vhdl实用例子100个 quartus 2 仿真源程序

2019-12-21 22:21:58 6.95MB veriloghdl vhdl实用例子100个 quartus2仿真 源程序

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基于VHDL语言的数字钟设计

基于Quartus II的数字钟设计内含整个工程

2019-12-21 22:20:52 3.15MB VHDL Quartus II

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