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IIR.rar_iir_iir filter verilog_iir verilog_verilog IIR

使用verilog语言描述的二阶巴特沃斯IIR滤波器，程序中有参数说明，已经运行通过

2022-09-30 17:18:07 909B iir iir_filter_verilog iir_verilog verilog_iir

FPGA实现千兆网口UDP协议收发实例

该例程采用RGMII接口，实现的ARP请求接收，ARP应答响应，以及UDP协议收发，创建一个数据环回的案例，收到上位机数据将原样传到上位机。该例程与FPGA基础专栏中《E1--千兆以太网接口测试应用2022-09-07》对应，可与QT小项目中的《C9—Qt实现网络调试助手》实现上下位机联调。

2022-09-30 09:27:38 118.8MB FPGA verilog 千兆网口

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Verilog详细教程（PDF带书签）

Verilog经典教程之一，带书签浏览更方便，适合入门和进阶

2022-09-29 21:41:06 4.4MB Verilog 教程 PDF 书签

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VivadoLicense2037.lic

xilinx vivado验证必须的license文件，适用于近年来几乎全部vivado版本（2014-2021）

2022-09-28 16:44:06 1012B vivado xilinx fpga Verilog

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VIVADO 2021.2版本安装包及相关安装验证教程百度网盘Xilinx_Unified_2021.2_1021_0703

vivado2021.2 包含相关安装文件+安装验证文件，是百度网盘链接。全部文件大小大概在72G左右，下载前请确保电脑内有相应大小的空间。另附一份安装教程，可根据安装教程进行相应的安装。本安装包仅供个人学习研究使用，严禁用于商业用途。

2022-09-27 21:20:14 831KB vivado fpga xilinx Verilog

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[原创] Verilog代码美化工具(istyle 103.16), 内含CXX源代码

Verilog代码美化工具(istyle 103.16), 内含CXX源代码源代码 istyle_103_16_m.bz2

2022-09-27 11:41:00 68KB Verilog 代码美化工具 istyle 103.16

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基于verilog的边沿检测设计源码

基于verilog的边沿检测设计源码，包括上升沿和下降沿检测。

2022-09-26 20:38:53 460B verilog fpga 边沿检测 按键输入

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温湿度传感器 - soc系统 verilog quartus2+keil5

本设计是基于 AMBA 总线协议来实现的，主要实现的功能是 APB 外接 DHT11 温度传感器，在 LED 数码管上通过按键切换显示温度值/湿度值，并且每 5 秒通过 UART 在上位机 PC 实时显示。主要的架构如下图所示，ARM 处理器和 SRAM 挂载在 AHB 总线上，而 UART、RTC、DHT11、按键以及数码管则挂载在 APB 总线上。我们将 iic 增加了 apb 接口，也可以连接的 dht12 温湿度传感器进行 iic 传输。考核点：1）硬件访问 DHT11 2）UART 输出打印 3）RTC 定时 5s

2022-09-25 15:31:22 74.59MB soc fpga

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verilog 实例100.rar_verilog

verilog 实例100,涵盖的比较多的VERILOG实例，对初学者有比较大的帮助。

2022-09-25 13:01:22 363KB verilog

led.rar_verilog点灯

入门级verilog编写的led点灯程序

2022-09-23 22:01:33 525B verilog点灯

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