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verilog语言标准2001

verilog语言标准2001,fpga开发参考必备哦

2022-08-23 18:57:55 2.95MB verilog 标准 2001

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基于FPGA的verilog语言的双人对战井字棋程序

基于FPGA的verilog语言的双人对战井字棋程序，用8x8的双色点阵显示，4x4的矩阵键盘1~9实现双人对战，只有一个bug，不能判断输赢！！！！！

2022-06-25 09:08:10 4.26MB fpga verilog

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xilinx 使用vivado实现TDC，使用verilog语言，有博客介绍。

verilog实现TDC，高精度时间数字转换器，xilinx 使用vivado实现TDC，使用verilog语言，有博客介绍。

2022-06-21 10:28:57 20.58MB verilog vivado xilinx TDC

计算机组成原理课设.zip

一个压缩包,里面含有 Verilog源码和课设报告两个文件夹源码有六个实验 1/2分频器触发器全加器 8位比较器等还有个自选题存储器实验报告包括实验目的,实验题目,实验要求,仿真图分析,实验心得等直接就可以用了

2022-06-17 01:39:41 300KB 计算机组成原理 Verilog 简单Verilog语言入门 Verilog实验报告

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驱动蜂鸣器演奏歌曲

FPGA开发板蜂鸣器 verilog语言代码

2022-06-15 16:11:21 3.73MB 蜂鸣器 FPGA verilog语言

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M序列生成程序采用verilog语言

采用verilog语言生成m序列用用一位寄存器原理

2022-05-26 16:28:46 232B M序列 verilog

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基于Verilog语言的数字钟

Verilog语言设计数字钟，具有闹钟，校准，整点报时功能

2022-05-13 15:21:48 4KB codes

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Verilog语言

Verilog HDL 介绍 1. Verilog HDL 概述 2. Verilog HDL 的词法 3. Verilog HDL 常用语句 4. 不同抽象级别的不同抽象级别的Verilog HDL 模型．基本组合逻辑部件设计基本组合逻辑部件设计 1. 运算单元电路运算单元电路 2. 编码器编码器/ 译码器 3. 多路选择器

2022-05-05 20:18:33 2.13MB Verilog

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FPGA/cpld Verilog语言DDS

MCU控制FPGA/cpld产生步进为1Hz的正弦波，FPFA晶振频率为50M,最多产生10M

2022-04-29 21:30:29 9KB MCU控制FPGA/cpld产生步进为1Hz的正弦波

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用verilog 语言实现mfsk系统

这个是用verilog hdl语言编写的mfsk调制解调程序，在QuartusII上面已经仿真过的结果完全对的。

2022-04-27 14:14:16 821B verilog mfsk

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