针对NAND Flash应用，完成了并行化BCH编译码器硬件设计。采用寄存器传输级硬件描述语言，利用LFSR电路、计算伴随式、求解关键方程、Chien搜索算法等技术方法完成了BCH编译码算法在FPGA上的硬件实现。相比于传统串行实现方案，采用并行化实现提高了编译码器的速度。搭建了基于SoPC技术的嵌入式验证平台，在Nios处理器的控制下能快速高效地完成对BCH编译码算法的验证，具有测试环境可配置、测试向量覆盖率高、测试流程智能化的特点。
2023-04-05 19:09:36
277KB
1
随着电子信息的飞速发展，近年来，远程医疗监控技术也渐渐成为医疗界的一个热点。重要生命参数的远程监控给年老体弱者带来了方便
2023-04-05 15:50:36
276KB
1
介绍了一种智能信号转换模块的设计方法。这种智能模块采用了基于FPGA嵌入式软核系统，是基于NiosII软核处理器的架构，可以在模块上完全实现外部总线信号之间相互转换，无需驱动程序或操作系统的干预。同时对用户逻辑设计、用户逻辑集成、固件设计技术等内容进行了详细的介绍。
2023-04-03 14:04:41
166KB
1
16位ALU
该设计使用Nexys-4 DDR板实现了16位ALU。 ALU可以执行ADD，MULTIPLY，SUBTRACT和RIGHT SHIFT LOGICAL运算。 设计中编入了两个数字，用户使用Nexys-4 DDR板上的开关选择ALU操作。
内容
.xdc约束文件，verilog文件和PDF报告以及ASM-D图表，示意图和仿真结果。
2023-04-02 22:14:58
718KB
1