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CPU五级
流水线
verilog源代码
使用了verilog写的五级
流水线
。处理过了hazard,还有stall。
2019-12-21 19:30:28
24KB
verilog
CPU
五级流水线
1
支持中断处理的
流水线
CPU代码设计
北航计算机组成课程设计, 支持50条指令和中断异常处理的
流水线
CPU,内包含源代码和相应的测试文件
2019-12-21 19:29:36
31KB
中断处理,P7
1
mips多周期五段
流水线
使用ise开发;实现了三种类型一共43条指令;包括了本次的实验报告;通过定向解决了冲突,对于load和rr型指令采用暂停一周期再定向解决;
2019-12-21 19:27:09
8.69MB
多周期流水线
1
DES算法IP核的
流水线
设计
DES算法IP核 的
流水线
设计
2019-12-21 19:26:21
232KB
DES算法IP核
1
基于MIPS指令集的32位CPU设计与Verilog语言实现_
流水线
CPU
用Verilog语言设计的
流水线
CPU,资源里包含了源代码及
流水线
CPU结构图,与大家分享下
2019-12-21 19:24:19
9.74MB
MIPS
Verilog
1
模拟MIPS
流水线
处理器的verilog源代码
用verilog实现的mips
流水线
处理器的源代码,包括控制器、算术逻辑单元ALU、数据存储器、指令存储器、寄存器堆、外设单元以及
2019-12-21 18:54:54
15KB
cpu源代码
1
基于FPGA的AES加密算法的高速实现
介绍AES 算法的原理以及基于FPGA 的高速实现。结合算法和FPGA 的特 点,采用查表法优化处理了字节代换运算、列混合运算。同时,为了提高系统工作速度,在设计中应用了内外结合的
流水线
技术,并应用Altera 公司的开发工具及芯片进行实际开发。
2019-12-21 18:49:38
251KB
AES
FPGA
查表法
流水线技术
1
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