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使用Verilog实现的32位RISC处理器,4级流水线
微机原理课程大作业,大家可以参考。由多个v文件组成,包括了ALU、控制器、存储器、各种寄存器、多路选择器、符号扩展器、流水线、冒险、前传都有。并且各文件的接口很清晰。
2019-12-21 20:02:47
27KB
处理器
流水线
32位
微机原理
1
verilog编写的流水线cpu
本科组成原理实验课程作业 verilog编写的可执行22条指令的流水线CPU,不涉及缓存。
2019-12-21 19:56:44
12.05MB
Verilog
流水线
cpu
1
16位5级流水线CPU设计
使用Verilog实现16位5级流水线CPU设计
2019-12-21 19:55:59
2.34MB
5级流水线CPU
1
DSP体系架构 处理器的基本概念和流水线基本结构
DSP体系架构 处理器的基本概念(单片机、RISC、超流水线、超标量、超标量超流水线、VLIW)和流水线基本结构(三种指令格式 、流水线 、流水线中的相关 )
2019-12-21 19:52:47
3.11MB
DSP
1
非线性流水线调度算法的研究.pdf
本pdf文件有密码,密码见本人博客
2019-12-21 19:51:32
288KB
调度算法
非线性流水线
1
完整流水线追溯系统
完整流水线追溯系统,其中包含各种组件,DevComponents.DotNetBar.Design
2019-12-21 19:36:57
4.81MB
c#
1
java单功能流水线调度
用java写的单功能流水线调度程序,属于体系结构范畴
2019-12-21 19:36:37
2KB
java
单功能
流水线
1
流水线有符号除法器的FPGA实现
流水线有符号除法器FPGA实现,可直接仿真,内附除法器原理及激励文件
2019-12-21 19:34:11
6MB
verilog
除法器
1
CPU五级流水线verilog源代码
使用了verilog写的五级流水线。处理过了hazard,还有stall。
2019-12-21 19:30:28
24KB
verilog
CPU
五级流水线
1
支持中断处理的流水线CPU代码设计
北航计算机组成课程设计, 支持50条指令和中断异常处理的流水线CPU,内包含源代码和相应的测试文件
2019-12-21 19:29:36
31KB
中断处理,P7
1
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