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(Multisim数电仿真指导)JK触发器
教你怎么使用multisim做数电的仿真实验,mlitisim7,multisim8,multisim10都适用。
2022-01-08 22:55:37
270KB
multisim
数电仿真
数电
JK触发器
1
同步十进制加法计数器(JK).ms7
本电路实现了同步十进制加法计数器的功能: 电路能准确地按照十进制加法计数的规律进行计数. 读者应深刻理解本例的分析和设计过程, 以为日后设计更为复杂的同步时序逻辑电路打下基础.
2021-12-11 21:52:06
166KB
数字电路
1
基于st02工艺库绘制的JK触发器原理图以及版图
本资源是利用的华润上华0.5um的st02工艺库,利用st02和analoglib库设计出了JK触发器的原理图,再利用st02中的版图单元绘制出了JK触发器的版图,并最终通过了DRC和LVS验证。
2021-11-28 14:34:24
28KB
st02
JK触发器
版图
1
基于C++的LFSR+JK触发器代码实现
一种流密码,通过LFSR实现流密码的产生,JK实现非线性
2021-11-23 20:19:29
41KB
LFSR
JK
1
杭电数字电路课程设计-实验十-JK触发器设计实验
杭电数字电路课程设计-实验十-JK触发器设计实验 内含包括代码,仿真,引脚配置全套文件,可直接打开工程
2021-11-22 13:55:34
118KB
杭电数字电路课程设计
1
11进制基于JK触发器的计数器的multisim10仿真源文件
11进制基于JK触发器的计数器的multisim10仿真源文件 运行成功 设计简洁
2021-11-13 20:43:21
111KB
multisim10
计数器
11进制
jk触发器
1
触发器-verilog代码
异步复位触发器,同步复位触发器,D触发器,jk触发器
2021-11-05 09:43:34
2KB
触发器
verilog
D触发器
jk触发器
1
D和JK触发器的Verilog程序(Quartus II工程,三种)
三种D触发器的Verilog程序(Quartus II工程已经建立好,可以直接用) 带同步清0、同步置1 的D 触发器;带异步清0、异步置1 的D 触发器;带异步清0、异步置1 的JK 触发器
2021-10-30 03:47:18
519KB
Verilog
D触发器
Quartus
II
1
Apache2.4+tomcat8.0+Jk
亲测可用的完整 apache2.4+tomcat8.0+jk 版本的 负载均衡测试 安装包
2021-10-25 14:21:49
18.97MB
Apache2.4
tomcat8.0
JK
1
JK制服,破译文化圈层,把握Z世代风向,掘金细分市场.pdf
JK制服,破译文化圈层,把握Z世代风向,掘金细分市场.pdf
2021-10-25 14:01:15
3.46MB
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