Verilog数字系统设计教程(第2版)

夏宇闻verilog权威讲解，绝对够经典。

北京航空航天大学出版社出版的Verilog 数字系统设计（第二版）的课后题答案 重点 练习 课件

宇闻著Verilog数字系统设计教程pdf版。是数字系统设计的一本教程。

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3.7 多目标识别 若场景中存在多个目标，则可以通过多目标识别和定位进一步提高精度。另 外，在跟踪过程中，若因为遮挡、光照等因素，某个目标跟踪失败后，还可以通 过其它场景中的目标继续实现定位，因此多目标识别可以提高算法鲁棒性。 Harris-SIFT 特征匹配 目标1目标 0 目标N 仿射检验 仿射检验 仿射检验 目标 0 目标 4 ⋯ 目标 N 成 功 失 败 成 功 目标数据库 终止 图 3-12 多目标识别示意图 Figure 3-12 Framework of multiple-object recognition 如图 3-12所示，和单目标识别一样，多目标识别也分为特征匹配、仿射检验、 模式识别三步，不同的是，需要对匹配特征点集合按目标分类，再依次对各个类 别进行仿射检验，以判断当前场景中是否存在某个目标，算法概括如下： 离线：使用 Harris-SIFT建立目标数据库 在线： 1. 从当前场景图像提取 Harris-SIFT特征点 2. 快速搜索近似最近邻居，得到匹配特征点集合 3. 将匹配特征点按目标类别分类

本书系统介绍了数字系统设计相关的知识，主要内容包括：EDA技术、FPGA/CPLD器件、Vefilog硬件描述语言等。本书以Quartus II、Synplify Pro/Synplify软件为平台，以Verilog-1995和Verilog-2001为语言标准，以可综合的设计为重点，以大量经过验证的数字设计实例为依据，系统阐述了数字系统设计的方法与技术，对设计优化做了探讨。

一、要求：实现多功能数字钟，具备下列功能： 1、数字钟：能计时，实现小时、分钟、秒的显示； 2、数字跑表：精度至0.01秒 比如显示12.97秒； 3、闹钟: 可以设定闹钟，用试验箱上的蜂鸣器作为闹铃； 4、调时：可以对时间进行设定； 5、日期设定：能设定日期并显示当前日期； 6、除调时状态，其他状态均不应影响系统计时。 二、设计方案与设计思路： 整体程序通过例化10个模块后整合形成多功能数字时钟功能，各模块名称以及各模块的作用分别为： 1、总控制模块：用于控制调整时分秒、年月日以及闹钟的模式选择，以及控制三个add按键调整的对象。 2、分频器模块：用于分频得到1Hz计时时钟。 3、时分秒调整模块：处于计时器时分秒调整设置状态时，对应控制模块的三个add按键可以实现对计时器的时分秒数值的设置，并且有按键可以实现对时分秒模块进行设置数值的载入。 4、时分秒变量处理（计时）模块：用于计时，根据分频后的时钟每隔一秒使秒变量加一，满六十向分变量进一，以此类推实现分钟以及小时的进位。 5、年月日调整模块：处于日期年月日调整设置状态时，对应控制模块的三个add

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