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该工程是在vivado2018.2上点用千兆ip核1g/2.5g pcs/pma ethernet 实现千兆网口的例化，配置寄存器都已设置好，可在k7的板子上直接使用

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随着MIL-STD-1553B总线在航天和军工领域日益广泛应用,对其灵活性、可扩展性,低成本和小型化提出了更加苛刻的要求,传统的专用协议芯片实现方案已经不能完全满足需求.从新需求的角度出发,提出了一种以低成本FPGA为平台的1553B总线RT终端IP核方案,以片内逻辑实现1553B的全部RT终端协议.详细介绍了基于FPGA的1553B总线RT终端IP核硬件总体设计方案,IP核设计方法以及基于FPGA的1553B总线RT终端IP核的特性分析等.应用表明该终端节约了1553B总线的成本、降低功耗,提高了1553B的总线协议的效率.

第三版加入了SDK、PlanAhead、ChipscopePro、SysGen、AccelDSP、xps、ISIM和一些IP的License. 其中IP核的License向下兼容到8.2版本，再往下版本未测试。

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Xilinx FPGA FFT IP核完整的Vivado工程，用于实现FFT算法，可直接进行波形仿真，测试过没问题，另外还包含matlab仿真文件，时序波形仿真结果和matlab结果一致。