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米联客ZYNQ&SOC;修炼秘籍
和米联客的视频资料相对应,本书以实例为基础,结合ZYNQ7的相关知识,对
VIVADO
中与ZYNQ SYSTEM PROCESS的使用进行了详细的介绍
2022-02-22 17:19:10
65.77MB
vivado
zynq
1
vivado
license
本人亲测可用。(注意:修改license文件之后,必须重启电脑才能用)
2022-02-12 17:33:37
898B
license
1
microblaze读写IIC,读写SD卡,AXI_IIC IP访问EEPROM
经过验证的,IIC程序是通过AXI_IIC IP来访问EEPROM,自己开发的AXI_SPI_SD IP是通过SPI总线读写SD卡
2022-02-08 09:06:04
95.89MB
xilinx
vivado
AXI_IIC
EEPROM
1
FPGA实现2FSK调制、包络检波解调、位同步的
Vivado
工程
FPGA实现2FSK调制、包络检波解调、位同步的
Vivado
工程,包括完整的
Vivado
工程文件和MATLAB的仿真与设计文件; 输入比特速率1Mbps,采样频率50MHz,FskMod.v模块实现2FSK, FskDemod.v模块实现2FSK的解调,采样频率25MHz,包络检波由低通滤波器完成,位同步采用数字锁相环技术,采样频率为10MHz; 经过行为仿真,位同步后能解调模块能正确还原调制模块的输入数据。
2022-02-07 09:06:40
49.31MB
FPGA
DDS
通信原理
1
ADAU1716音频芯片驱动IP核
ADAU1716音频芯片的驱动IP核,使用
Vivado
软件,配套CSDN博客【ZYNQ-7000开发之十六】音频信号处理使用
2022-02-03 14:14:56
21.9MB
vivado
1
FPGA实现ASK幅度键控调制、包络检波解调、位同步的
Vivado
工程
FPGA实现ASK幅度键控调制、包络检波解调、位同步的
Vivado
工程,包括完整工程文件和MATLAB的仿真与设计文件; 输入比特速率1Mbps,采样频率10MHz,AskMod.v模块实现幅度键控调制,AskMod_Beamform.v模块实现基带波束成形和幅度键控,二者在顶层文件中例化一个就可以; AskDemod.v模块实现2ASK的解调,采样频率10MHz,包络检波由低通滤波器完成,位同步采用数字锁相环技术; 经过行为仿真,位同步后能解调模块能正确还原调制模块的输入数据。
2022-01-31 13:07:38
34.21MB
fpga
dsp
通信原理
1
vivado
+zedboard入门实例lab41
这个例子很好,一个完整的嵌入式系统的例子。测试Switch0-7和BTNR,可通过GPIO IP通过PL部分对开关和相应LED操作,也可以通过EMIO直接让PS与BTNR通信。
2022-01-28 15:14:44
16.99MB
vivado
zedboard
入门实例
1
FPGA Xilinx
Vivado
Licese ~~~ work to 2037
赛灵思
Vivado
开发环境 Licese , 有效到2037
2022-01-24 13:01:07
14KB
fpga开发
Vivado
license
1
Vivado
的FIR IP核实现低通滤波器工程
Vivado
的FIR IP核实现低通滤波器工程,包括完整工程文件和MATLAB设计FIR的.m文件; 采样频率10MHz,输入信号为1MHz和3MHz的正弦波的叠加信号; FIR滤波器为低通滤波器,通带0~1MHz,阻带高于2MHz; 经过行为仿真,滤波器能够有效滤除3MHz正弦信号,保留1MHz正弦信号。
2022-01-24 09:08:36
13.37MB
fpga开发
dsp
1
vivado
fft ip核英文文档
vivado
fft ip核 V9.1版本,英文官网手册
2022-01-24 09:02:17
2.1MB
fpga
1
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