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基于verilog语言的8位CPU设计
这是一个简单的8位CPU设计,基于verilog HDL 语言, 在一个模版上进行修改得到的版本,适合于初学者学习使用
2019-12-21 18:51:24
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verilog
中断
嵌套
子程序调用
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Verilog语言设计电梯控制器文档
Verilog语言设计电梯控制器文档,关于电梯控制器的设计。东西不错
2019-12-21 18:50:02
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VERILOG语言编写的贪吃蛇小游戏
数字电路课程设计,自己制作的贪吃蛇,小游戏,使用的开发软件是ISE14.7,可以直接运行
2019-12-21 18:47:56
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FPGA实现UDP协议栈,verilog语言附带说明
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2019-12-21 18:44:26
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vhdl转换成verilog语言
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任意分频的verilog 语言实现(占空比50%)
任意分频的verilog 语言实现(占空比50%) 1. 偶数倍(2N)分频 2. 奇数倍(2N+1)分频 3. N-0.5 倍分频 4. 任意整数带小数分频
2012-12-11 00:00:00
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