基于双边带相位控制技术的光子微波移相器
2021-03-13 16:07:31 1.36MB 研究论文
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运放移相器电路图multisim10做的,可以在-45和正45度间变换调节。 运放移相器电路图multisim10做的,可以在-45和正45度间变换调节。
2021-03-09 09:06:24 88KB 移相器
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4bit超前进位加法器(CLA)源代码,用组合逻辑实现
2021-02-26 11:13:48 869B CLA 加法器 verilog
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2.3.加法器工程
2021-02-25 09:05:54 74.81MB Qt C++
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xilinx公司的加法器核.7z
2021-02-03 12:31:04 1KB xilinx公司的加法器核.7z
第4关:16位快速加法器设计.txt
2020-12-17 16:58:55 637KB 第4关:16位快速加法器设计
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它是基于EDA MAX+plus 集成环境下,全加器的设计用一位全加器来设计四位全加器
2020-04-24 12:13:25 6KB 全加器
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Hdu计组 Verilog实验二16位超前进位加法器减法器。希望能帮到大家的实验。
2020-04-17 19:44:15 224KB Verilog
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包括4位超前几位加法器,32位超前进位加法器及测试程序和电路图
2020-01-03 11:43:07 251KB 32位超前进位加法器 VHDL
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32位浮点数加法器 也算是减法器 其中32位浮点数用的是IEEE 754标准表示的 根据别人的改写的 有问题欢迎大家指出 信号定义不是很完整 verilog编写的
2020-01-03 11:18:01 4KB IEEE754 加法器
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