用于Verilog代码中模块的例化,可直接先将module部分转换成例化后的语句,并且实现代码对齐。使用MATALB2019a的APPdesigner编写
2023-03-08 22:29:53 52KB FPGA开发小工具
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[FPGA开发技术与应用实践][贺敬凯,王永强][电子教案和教学指南]
2023-03-08 08:55:39 98.47MB FPGA
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1.2 FPGA 引脚配置 2.2 再来说说 HDL 思路 2.2.1 分频部分 2.2.2 读取 ADC 转换值部分 2.2.3 增益处理和 DAC 输出波形
2023-03-05 19:43:07 590KB fpga开发
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2.1. 2.2. 2.3. 2.4. 3.1. 3.2. 4.1. 4.2. 4.2.1. 8 位独立 LED 显示设计实验 26 4.2.1. 基于 74H
2023-02-28 16:11:22 9.88MB fpga开发 图像处理 算法
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关键字 光立方 3D动态显示 RGB 语音控制 FPGA目 录设计概述第一部分 设计概述 /Design Introduction 4 1.1 设计目的 4 1
2023-02-25 20:12:59 10.53MB fpga开发 3d
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图 3-1 Series FPGAs Memory Interface SolutionStep1:任意创建一个新的空的工程(创建工程的具体工程如果还不清楚的看
2023-02-25 13:37:16 3.15MB fpga开发
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用纯verilog实现测距码的产生,PN码
2023-02-15 15:53:12 5KB fpga开发
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基于FPGA的数字电子时钟,采用verilog语言编写,引脚已经设置好,直接运行上传即可使用。本文是用verilog语言来描述一个基于FPGA的多功能数字电子时钟的设计,该设计具备时间显示,准确计时,时间校准, 定时闹钟等功能。本文首先介绍了需要完成的工作,然后介绍了系统整体设计以及源代码开发过程。源代码首先在Quartus软件上进行仿真、综合,通过后下载到正点原子新启点开发板上,在FPGA器件上的试验结果表明上述功能全部正确,工作稳定良好。 1、能够用数码管或液晶屏显示时、分和秒(采用24小时进制); 2、具有按键校时功能,对小时和分单独校时,对分校时时,停止向小时进位; 3、具有闹钟功能,闹钟铃声为自主设计的用蜂鸣器发出的声音; 4、通过按键设置闹钟功能,且自动停闹和手动操作停闹; 5、其它创意设计:增加闹钟模式开启指示灯和闹铃提示灯;可以作为秒表使用。
2023-02-14 19:42:52 8.91MB fpga FPGA开发 verilog 课程设计
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NetFPGA-1G-CML: Kintex-7 FPGA开发板 用户手册.pdf
2023-02-14 19:22:15 1.11MB Kintex-7 FPGA NetFPGA-1G-CML
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1. 项目内容概括:利用 PS/2 键盘、音响和 Nexys4 开发板完成一架电子琴的设 2. 键位设置:采用 3 组全音阶,即加入半音,模拟电子琴的黑白键 3
2023-02-13 11:33:26 3.67MB fpga开发
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