对Xilinx VC709的原理图的解析,重点对DDR3进行了介绍
2021-12-24 14:59:58 846KB FPGA DDR3 Xilinx 原理图
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micron ddr3 仿真模型 verilog版本
2021-12-22 17:10:02 69KB micron ddr3 仿真模型
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sp605串口读写ddr3
2021-12-21 20:23:43 2.9MB sp605 串口 ddr3
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迄今为止最好的DDR3讲解文档,深入浅出,包含DDR的片内结构 DDR的读写流程 DDR的基础命令 DDR的读写时序与参数 等内容,是深入学习DDR的好文档
2021-12-19 17:00:30 1.35MB DDR3
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此文档对于JESD标准LPDDR4解读,轻松理解LPDDR4标准。 问题举例: ** LP4 vs LP4X ** 为什么2018旧款 Macbook Pro只用LP3, 而不用LP4? ** Apple M1如何做到性能很强呢? ** LPDDR4有ECC吗? ** LVSTL模型的意义? ** 为什么LPDDR4钟情于16bit per channel? ** Pad Order究竟是何物? ** 为什么有EMCP这种封装? ** 为什么有ZQ pin? ** LPDDR可以取代DDR? ** 为什么LP4和DDR4 prefetch差异很大? ...... ** 行业标准: 作者有数年spec经验, 熟悉JEDEC标准建立的过程. ** 专业: 数年dram问题debug,spec解读专业到位。 ** 咨询: 承诺文档解读有疑问,可以免费每天3个问题的解答。 ** 退款: 作者承诺如果对于文档解读不满意,可线下联系作者申请退款. 如对内容质量有疑问,可提前私信咨询。
2021-12-18 16:00:28 10.76MB LPDDR4 LPDDR3 DDR4 DDR3
ddr3的五篇pdf,vivado下 的操作步骤.rar
2021-12-17 01:17:28 5.57MB vivado DDR3 MIG
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2021-12-14 09:51:24 21.95MB XILINX DDR3
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2021-12-12 16:00:24 7.09MB LPDDR3 DDR3 LPDDR4 DRAM
DDR3 Software Leveling and Registers Configuration 方法
2021-12-11 20:20:17 365KB AM335x
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2021-12-09 15:51:55 21.95MB XILINX DDR3
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