基于SOPC多波形信号发生器[摘 要 设计了一种基于SOPC的多波形信号发生器,系统由核心主板和显示及输入模块组成,核心主板为一片Altera公司的CycloneII系列的FPGA和高速DAC组成片上系统开发平台,FPGA中配置NiosII软核CPU、信号发生模块和相关的接口控制逻辑电路,显示和输入部分为分辨率为240*32]
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基于FPGA的电子系统设计技术是21世纪电子应用工程师必备的技能之一,而基于FPGA的SOPC设计技术是当前电子系统设计领域最前沿的技术之一。SOPC设计具体包括以32位NiosII为核心的嵌入式系统的硬件配置、硬件设计、硬件仿真、软件设计以及软件调试等。本资料是基于FPGA的SOPC嵌入式系统设计与典型实例光盘文件设计实例5,6,7
2021-05-25 18:45:58 37.85MB FPGA Altera SOPC Verilog
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数字电压表 在Nios II CPU中添加通用I/O模块作为A/D和D/A的输入输出引脚。 在Nios II IDE下编写程序模拟A/D和D/A的时序,发送和接受信号 测量分辨率 0.02V。
2021-05-25 17:59:44 13.71MB sopc Nios II
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基于SOPC技术实现数字闹钟,本实验指导书演示了NiosII系统的硬件设计,软件设计,能实现一个电子钟功能。 本实验在前面实验的基础上,同学已经能熟练的使用QuartusII软件和模块化输入方法。 本实验主要包括SOPC Builder,NiosII IDE,QuartusII的使用,主要目的在于指导同学学习如何定制一个NiosII硬件系统和如何在此基础上编写软件程序。
2021-05-25 17:54:51 351KB sopc vhdl 闹钟
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基于SOPC的电子时钟日历 使用了niosII 和 sopc build 电子钟 还有设置年月日时分秒
2021-05-25 17:20:10 9.41MB sopc NiosII 电子钟 FPGA
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基于FPGA的SOPC交通灯实时控制系统设计代码(NIOSII开发板)
2021-05-22 11:54:23 9.1MB fpga  sopc
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基于Nios II的嵌入式SoPC系统设计与Verilog开发实例书本-源代码
2021-05-14 10:22:37 3.98MB Nios II
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SOPC种逻辑模块的添加说明.可以仔细阅读参考
2021-05-13 17:32:04 566KB SOPC
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该文件详细讲述了使用DE2开发板开发基于SOPC的音乐播放器的软核搭建过程,并配有图片说明。使用的工具是Quartus II中的SOPC Builder。
2021-05-08 16:50:19 647KB DE2 音乐播放器 SOPC软核 搭建流程
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数字集成电路:电路系统与设计(第二版)中的PPT,很详细,适合配套的书籍一起看。
2021-05-07 22:36:17 16.32MB ASIC SOPC
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