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计算机组成原理课设.zip
一个压缩包,里面含有 Verilog源码和课设报告两个文件夹 源码有六个实验 1/2分频器 触发器 全加器 8位比较器 等 还有个自选题存储器 实验报告 包括实验目的,实验题目,实验要求,仿真图分析,实验心得等 直接就可以用了
2022-06-17 01:39:41
300KB
计算机组成原理
Verilog
简单Verilog语言入门
Verilog实验报告
1
verilog实验报告
verilog实验报告
,大一
2022-05-02 14:01:21
3.09MB
fpga开发
1
华中科技大学
verilog实验报告
及源码
华中科技大学
Verilog实验报告
及完整源代码,可以直接用,全部本人编写。源代码文件名称在报告中有交代,仿真截图和原理图都有。直接用vivado2015.2打开即可。
2021-09-11 23:11:00
2.03MB
华中科技大学Verilog实验
Verilog
实验报告
华中科技大学实验报告
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