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西工大计算机组成与结构基础实验满绩单周期、流水线CPU代码、报告
实验分块在压缩包内,包含所有.v源文件,有的有QuestaSim或Vivado仿真工程,含有单周期和流水线报告各4份,最终实验成绩满绩。
2022-11-03 15:20:31
20.32MB
西工大
计算机组成
CPU
流水线
1
电子科大计算机系统结构
CPU流水线
课程设计
电子科大GSL的课设,单周期五级流水线CPU,让加个中断什么的。
2021-11-29 12:52:51
563KB
电子科大
系统结构
CPU
流水线
1
mips指令
cpu流水线
vsd图
MIPS是世界上很流行的一种RISC处理器。MIPS的意思是“无内部互锁流水级的微处理器”(Microprocessor without interlocked piped stages),其机制是尽量利用软件办法避免流水线中的数据相关问题。这个文件就是mips指令
cpu流水线
vsd图。
2021-10-12 17:52:06
533KB
cpu
mips
vsd
1
简单流水线cpu
编译通过的简单流水线cpu 可实现24条指令 包含rom和ram
2021-07-07 14:39:36
1.52MB
vhdl
简单cpu
流水线
1
五级流水线CPU完整设计(包括control hazard和data hazard处理)
建议师弟师妹们还是要自己写,完整地理解好CPU设计的思路,不要直接在网上找到就抄。http://blog.csdn.net/c602273091/article/details/35883557 大家可以到师兄博客看一下hazard解决的思路分析。
2021-06-08 09:33:26
17KB
CPU
流水线
Hazard
1
通用自适应光学波前实时处理机的设计
为满足天文观测及激光通信等领域的1000单元级以下的自适应光学(AO)系统的高速实时处理的要求,提出一种单板上实现高速实时计算的通用化技术方案。采用多核CPU实时计算波前,结合高速图像采集卡,以满足系统高帧频的需求;计算机系统采用Xenomai实时操作系统及Linux操作系统,以满足AO 系统低延迟的需求;实现了在单台计算机上集成实时处理与监控的紧凑型处理系统。采用向量指令优化及多核并行运算,在6核的计算平台上获取了峰值每秒510亿次浮点运算的计算能力,102 GB/s的通信带宽。仿真结果表明可以对1145个驱动器,949个子孔径的系统进行2000 Hz的处理,处理延迟低于240 μs;通过修改参数后,应用于光通信的137单元AO系统中,校正后斯特列尔比为0.61。结果表明该处理方案能满足1145单元以下AO 系统2000 Hz实时处理的需要,并具有通用性。
2021-02-24 18:05:20
2.09MB
自适应光
实时处理
多核CPU
流水线处
1
verilog流水线CPU
五级流水CPU,除了最基本的条件、非条件转移指令,算术、逻辑运算指令和访存指令等,还实现了弹压栈指令、子程序调用和返回指令、除法指令和三角函数指令。 代码风格可能不太好,仅供大家参考。
2019-12-28 17:33:06
563KB
CPU
流水线
verilog
1
北航计算机组成P0-P6
其中包含1.利用logisim实现斐波那契数列、Moore及Mealy型有限状态机等题目的电路,及利用logisim实现单周期CPU。2.利用verilog实现单周期及多周期流水线CPU。3.利用Mars编写汇编,包括哈密顿回路、循环递归等题目代码
2019-12-21 21:44:17
10.17MB
logisim
ISE&verilog;
Mars汇编
CPU流水线
1
计算机组成实验Project5流水线CPU源代码
通过强测和P5课上测试,支持addu,subu,ori, beq,lw, sw, lui, j, jal, jr, nop指令; 支持转发和暂停处理冲突机制; 仅可用于参考,不要将其直接上传,否则被查重后果自负。
2019-12-21 21:41:43
17KB
Verilog
CPU
流水线
北航
1
五级流水线MIPS指令集cpu设计,verilog语言,通过modelsim与ISE并下载FPGA验证(计算机组成原理)
五级流水线MIPS指令集cpu设计,verilog语言,通过modelsim与ISE并下载FPGA验证(计算机组成原理)
2019-12-21 21:38:09
9.01MB
MIPS
CPU
流水线
1
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