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Verilog-HDL-数字系统设计[夏宇闻]ppt课件
Verilog-HDL-数字系统设计[夏宇闻]ppt课件
上传者:
jiang_x_y
|
上传时间: 2022-08-30 19:27:49
|
文件大小: 15.24MB
|
文件类型: RAR
数字系统设计
夏宇闻
Verilog-HDL-数字系统设计[夏宇闻]ppt课件,主要内容有共17章:Verilog的基本知识、Verilog的语法结构、Verilog HDL模型的不同抽象级别、复杂数字系统的构成、同步状态机的原理、结构和设计、可综合的状态机的指导原则、阻塞和非阻塞赋值、数字电路设计实践等。
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