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32-bit-Floating-Point-ALU:单精度浮点加法系统-源码

32位浮点ALU 32位浮点单元，用于执行加法和减法。

2021-04-05 18:54:38 4KB VHDL

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51单片机ALU的VHDL代码

51单片机ALU的VHDL代码，可以作为ALU的代码例子

2021-04-01 17:08:10 5KB ALU VHDL

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8位可控加减法器设计、32位算术逻辑运算单元ALU设计、四位先行进位74182、四位快速加法器、8位快速加法器、16位快速加法器、5位阵列乘法、6位补码阵列乘法器等电路，已画好。alu自动测试是100分。

2021-03-30 11:37:57 710KB logisim 计算机组成原理 实验

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4位BCD码加法器的设计

ALU的设计与仿真—4位BCD码加法器的设计本次的设计内容是ALU的设计与仿真—4位BCD码加法器的设计。

2021-03-16 20:11:03 463KB 模型机 ALU BCD码 加法器

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VHDL ALU 32 BIT

BU 32 bitlik bir vhdl kodudur.

2021-03-16 20:07:07 15KB VHDL ALU

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ALU Verilog计组实验文件

Hdu计组 Verilog实验三ALU。希望能帮到大家的实验。

2021-02-27 18:31:01 67KB ALU 计组 Verilog

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华中科技大学计算机组成原理实验记录 32位ALU设计实验（运算器设计) circ文件可直接执行。

2020-11-01 11:54:53 812KB 华中科技大学 谭志虎 华科计算机组成原理+存储系统实验

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华中科技大学计算机组成原理ALU实验（Logisim）

该文件包含Educode上ALU实验的大部分关卡，均可通关。全部连接方法可参照我的第一篇博客。实验重点为运算器原理的考察，而并非线路和器件连接方式，但是在连接线路是要注意引脚的说明，避免浪费不必要的时间。

2020-11-01 11:36:16 461KB 计算机组成原理 Logisim

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educoder运算器设计alu.circ

educoder logism 计算机组成原理 8位可控加减法电路设计CLA182四位先行进位电路设计等九关完整答案，已通过。

2020-05-11 10:15:50 540KB logisim educoder 计算机组成原理 运算器设计

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.circ文件。华中科技大学计算机组成原理实验二运算器实验Logisim源文件，里面有8位可控加减法器设计、32位算术逻辑运算单元ALU设计、四位先行进位74182、四位快速加法器、8位快速加法器、16位快速加法器、5位阵列乘法、6位补码阵列乘法器等电路，已经连接画好了。alu自动测试是100分。

2020-05-10 00:17:06 41KB 8位可控加减法器设计 32位算术逻辑运算单元ALU设计 Logisim 四位先行进位74182

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