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second.circ

运算器设计(HUST)11关全通代码

2021-05-08 09:04:38 731KB 运算器 头歌

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华科计算机组成原理实验-运算器1-8关circ完整文件alu.circ

基于logisimcn&Educoder平台，华中科技计算机组成原理实验-运算器(HUST)，1-8关circ完整文件

2021-05-07 11:02:39 507KB 华科计算机组成原理实验-运算器

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educoder (2).circ

2021-05-07 09:04:40 587KB educoder计算机组成原理

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MIPS RAM设计3.3.circ

Logisim 中 RAM 组件只能提供固定的地址位宽，数据输出也只能提供固定的数据位宽，访问时无法同时支持字节/半字/字三种访问模式，实验要求利用4个8位的 RAM 组件进行扩展，设计完成既能按照8位、也能按16位、也能按照32位进行读写访问的32位存储器，最终存储器引脚

2021-05-06 23:06:26 1.37MB MIPS RAM设计 第三模块第三关

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全相联cache设计.circ

全相联cache设计存储系统设计(HUST) 计算机组成原理

2021-05-05 09:00:57 1.49MB 全相联cache设计

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汉字字库存储芯片扩展实验.circ

汉字字库存储芯片扩展实验存储系统设计(HUST) 计算机组成原理华中科技大学

2021-05-05 09:00:56 1.38MB 汉字字库存储芯片扩展实验

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华中科技大学运动码表.circ

2021-04-30 11:56:53 359KB 华科网安 数电 运动码表

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运算器设计（HUST）alu.circ

华中科技大学实验设计，包含8位可控加法电路设计到MIPS运算器设计等11项已通关实验。

2021-04-25 18:02:15 725KB 运算器实验设计

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educoder数据实验表示.circ

华中科技大学计算机数据表示实验测评通过文件。汉字国标码转区位码实验汉字机内码获取实验偶校验编码设计偶校验解码电路设计16位海明编码电路设计16位海明解码电路设计海明编码流水传输实验16位CRC并行编解码电路设计CRC编码流水传输实验

2021-04-23 14:44:33 524KB educoder logisim 计算机数据表示

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cpu实验3.circ

单周期MIPS CPU设计、微程序地址转移逻辑设计、MIPS微程序CPU设计、硬布线控制器状态机设计、多周期MIPS硬布线控制器CPU设计（排序程序）。在educoder上测试通过。

2021-04-22 18:58:21 172KB educoder logisim cpu

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