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数字逻辑课设:数字时钟(logisim文件).
circ
数字逻辑系统设计实验,使用74LS90,74LS390,7段数码管译码器,制作数字时钟,具有更改时间和报时功能
2021-04-08 18:07:48
98KB
数字时钟
数字逻辑系统设计
74LS90
logism
1
数字逻辑课设:简易秒表设计(logisim文件).
circ
注意:先按快捷键Ctrl+K让时钟自动跳动!!! 利用logisim软件完成简易秒表设计。 要求: 1、具有时钟源产生1S的信号 2、能够通过数码管显示,显示最大值为59,具有时间暂停功能 3、能够通过按键清除上次计数时间值
2021-04-08 14:08:31
107KB
logisim
秒表
数字逻辑
74LS160
1
华中科技大学组原实验1-6 data-EduCoder-3-29.
circ
计算机组成原理的6个实验 使用logisim实现 国标转区位码 汉字显示 偶校验编码 偶校验检错 海明编码 海明解码
2021-04-05 15:12:35
570KB
组原
1
华科计算机组成原理实验-运算器1-11关
circ
完整文件
Educoder平台,华中科技计算机组成原理实验-运算器(HUST),1-11关
circ
完整文件,自己做的
2021-03-31 15:39:22
724KB
Educoder平台
华中科技计算机组成原理实验
运算器(HUST)
circ完整文件
1
计算机组成原理实验课程 实验一 运算器设计(加法器设计)8位可控加减法器设计、32位算术逻辑运算单元ALU设计alu.
circ
8位可控加减法器设计、32位算术逻辑运算单元ALU设计、四位先行进位74182、四位快速加法器 、8位快速加法器、16位快速加法器、5位阵列乘法、6位补码阵列乘法器等电路,已画好。alu自动测试是100分。
2021-03-30 11:37:57
710KB
logisim
计算机组成原理
实验
1
数字逻辑课设:数字时钟(logisim文件).
circ
注意:先按快捷键Ctrl+K让时钟自动跳动!!! 利用logisim软件实现数字时钟。 要求: 1. 利用logisim自带的元器件:各种逻辑门(Gate)、触发器(Flip-Flop)、7段数码管(7-Segment Display)等实现显示时、分、秒的数字钟。 2. 两位数码管显示小时并满24进位,两位显示分钟和两位显示秒钟的数码管满60进位。 3. 制作子电路芯片实现7490/74390(计数/分频)、4511/7448(7段数码管译码)的功能。不可以使用logisim自带工具:计数器(Counter)和十六进制显示器(Hex Digit Display)。 4. 方波信号使用Clock工具产生,自行设置电路时钟频率和分频电路,使计时贴近真实时间。
2021-03-23 15:13:48
133KB
logisim
数字时钟
74LS90
74LS390
1
计算机组成原理课设:原码一位乘、补码一位乘(logisim文件).
circ
计算机组成原理课程设计内容,跟着老师的讲解,自己一步步做的。 (1)Logisim仿真乘法器,原码一位乘。 (2)Logisim仿真乘法器,补码一位乘。
2021-03-04 20:13:50
67KB
logisim
乘法器
原码一位乘
补码一位乘
1
24条指令cpu+分支流水线实验(完整).
circ
此资源在多方大佬的协助下完成的,看网上几乎没有关于24条单周期指令的电路设计图还有分支流水的电路图,于是贡献出来跟大家一起分享,因为是有偿的,所以就设定了积分,便于以后能够发更好的资源给大家分享~谢谢了
2021-02-17 18:27:44
1.03MB
logisim
cpu
分支流水
1
数电期末实验设计.
circ
logisim数电期末实验设计.
circ
, 包含:实验一:逻辑门基本功能测试。实验二:设计一片74138.实验三:设计一个8位的二进制加法器。实验四:基本SR锁存器功能测试。实验五:设计一个60进制的计数器。5个实验均包含电路图和实验步骤,实验心得等,请用logisim.exe软件打开,此乃原创,期末时得到优秀等级,欢迎下载。
2021-01-28 02:46:52
85KB
实验
logisim利用半加器计算8位原码求补码.
circ
实验设计:利用半加器计算8位原码求补码的电路图,请用logisim.exe打开,欢迎下载。
2021-01-28 02:46:51
24KB
数电
实验
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