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硬件描述语言基础教程_verilog应用开发
数字逻辑设计 计算机体系结构 计算机组成原理 C语言程序设计 数字逻辑系统的基本单元是:与门、或门和非门,它们都是由三极管、二极管和电阻等器件构成,并能执行相应的逻辑功能;与门、或门和非门又可以构成各种触发器,实现状态记忆。有了这些基础,我们就可以利用布尔代数和卡诺图简化方法来设计一些简单的组合电路和时序电路。
2021-04-20 16:50:37
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2021-01-07 16:44:26
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基于Tomasulo算法的32位RISC带Cache的流水线CPU设计
清华大学电子系微机原理课程设计题目。4人合作完成。 包含CPU的VHDL、Verilog源代码、仿真文件、波形结果、系统框图、实验报告、以及一个简易汇编器的源代码和可执行文件。 Quartus仿真实现了32位RISC微处理器,支持数据处理(包括乘除法),数据传送,子程序调用,中断及跳转。时序仿真主频可达70MHz。 采用Tomasulo算法处理指令流水中的数据相关,并提出了一种对Tomasulo就够的改进。设计了Cache结构提高访存效率。
2019-12-21 22:06:27
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微机原理
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VHDL硬件描述语言与数字逻辑电路设计_12302748.pdf,超星
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大学,数字逻辑基础与verilog硬件描述语言课后答案。通过verilog语言
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