摘要: 为了提高系统的集成度和可靠性, 降低功耗和成本, 增强系统的灵活性, 提出一种采用非常高速积体电路的硬件描述语言( VH DL 语言) 来设计数字基带传输系统的方法。详细阐述数字基带传输系统中信号码型的设计原则, 数字基带传输系统中信号编码原理和译码原理; 采用硬件描述语言来设计数字基带信号编码器和译码器并进行仿真; 采用原理图设计方法设计数字基带传输系统并仿真; 整个系统的设计在QuartusⅡ平台上完成, 并在Altera 公司的ACEX1KEP1K30TC144-1 芯片上实现。 　　0 引 言 　　现代通信系统中, 数字通信系统所占的比例越来越大, 系统的数字化、集成化是未

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目前星载信号处理平台中大量使用商用芯片，但商用芯片抗辐射能力较弱，在空间环境下常出现单粒子翻转(Single Event Upset，SEU)，从而造成系统功能紊乱，甚至中断。提出以星载信号处理平台中大量使用的SRAM型FPGA为研究对象，采用故障注入的方式研究FPGA中不同硬件资源对于SEU效应的敏感性问题。根据不同资源对SEU效应表现出不同敏感性的结论，可在SRAM型FPGA的抗SEU防护上进行有针对性的设计。

该资源主要是cyclone10_GX官网库（内含原理图、PCB、测试相关例程、test软件、技术手册）、原理图、quartus Pro 18.1使用手册、以及自己编写的点亮LED的程序，亲测可用。