突破板上的iCE40 UltraPlus FPGA示例 ice40 ultraplus fpga的示例集合,每个示例都测试了fpga(例如spram)的功能,并且彼此独立。 所有示例均在晶格的ice40 ultraplus突破板上运行( ),其中包含ice40 ultraplus fpga(iCE40UP5K),闪光灯,ftdi usb-to-spi针芯片和一个RGB LED。 一些示例包括: RGB LED闪烁 RGB LED上的PWM 从FPGA读取和写入SPRAM模块 与主机的SPI通信 使用软IP模块 在iCE40上使用硬件SPI模块 读写BRAM 从FPGA读取闪存(N25Q032A) 具有MAC(乘法和累加)操作的DSP( SB_MAC16 )示例 在FPGA上运行的RISC-V实现 RISC-V将上述所有示例组合在一起,以构成一个完整的工作系统,该系统能够在与L
2022-05-15 21:53:05 60KB fpga verilog risc-v ice40
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用verilog编写的图像采集程序,内有测试程序和激励程序testbench
2022-05-15 15:47:07 382KB verilog modisim
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适合入学者,手把手一步一步讲解cpu的设计,用verilog编写,简单明了。文档里有代码
2022-05-15 01:14:27 47.31MB verilog fpga cpu
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采用DE2核心FPGA 开发板,设计一个数码管循环显示程序。通过编程在数码管上显示八位英文字符和数字
2022-05-14 23:29:05 145KB verilog 程序 设计
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代码中修改一个参数就可以实现两种屏之间的切换
2022-05-14 21:54:30 3.16MB verilog TFTLCD ILI9320 ILI934125
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RS(204,188) 译码器 设计 verilog 仿真功能实现
2022-05-14 16:58:07 14KB RS(204 188) 译码器 设计 verilog
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用于美化 VHDL 和 Verilog 文件的脚本 依赖关系 您的路径中需要一个比 0.22 新的 emacs 版本 - 我只用 GNU Emacs 23.3.1 进行过测试 用法 ./verliog-pretty < ugly> pretty-verilog.v ./vhdl-pretty < ugly> pretty-vhdl.vhd 这个怎么运作 脚本启动 Emacs,加载正确的“文件模式”并调用该模式的重新格式化命令。 该存储库包括以下用于格式化 VHDL/Verilog 的“Emacs 模式”。 Emacs VHDL 模式 -- Mac 的 Verilog 模式 -- ||
2022-05-14 16:28:41 440KB EmacsLisp
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Verilog HDL 数字设计与综合(第二版)[夏宇闻等译]是学习Verilog 语言最好的教材之一。
2022-05-14 14:19:17 12.19MB Verilog HDL
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verilong 数字钟代码 24小时制,可现实星期,仿真通过
2022-05-13 19:33:41 1KB verilog 数字钟
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