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基于FPGA+DDS的位同步时钟恢复设计与实现
针对目前常用位同步时钟恢复电路即超前-滞后型锁相环和1位同步器两种方法的不足之处,提出了一种使用DDS原理实现的快速时钟恢复方案。该方案采用DDS技术作为高精度任意分频单元,并在此基础上结合两种方法的优点,完成了位同步时钟恢复的改进设计。该方法适用频率范围宽,同步速度快,同步精度高,能够有效地降低频差的影响。给出了方案设计原理及实现方法,使用FPGA完成设计并对其性能做了分析及仿真、测试。
2022-03-26 15:21:09
312KB
FPGA
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基于vhdl的数字时钟设计
本文档基于vhdl设计数字时钟并且带有置数和闹钟功能。
2022-03-26 12:54:31
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vhdl
数字钟
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Qt5实战项目,本代码博客: http://blog.csdn.net/wu9797/article/details/79013920
2022-03-26 08:58:33
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Qt
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用1602做简易时钟
功能:用1602显示 00:00:00 的简易时钟。
2022-03-24 17:52:23
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1602
时钟显示
程序设计
STC89C52
1
stc89c51电子时钟.zip
stc89c51电子时钟.zip
2022-03-24 15:51:19
40.81MB
89c52
1
数字时钟 VHDL程序
用FPGA设计一电子时钟,时间有时、分、秒,并分别用七段数码管显示出来。要求:时间增减可调,数码管动态显示。
2022-03-24 11:21:18
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数字时钟
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一种低时钟频率下UHF RFID标签芯片PIE解码电路的实现方案
对于标签芯片,降低系统时钟频率是降低功耗、提高通讯距离的最有效手段。首先从理论上按照一种等效判决方法推导出PIE解码电路的更低时钟频率,提出了一种低时钟频率下基于ISO 18000-6 TYPE C协议的UHF RFID标签芯片解码电路的实现方案。设计的解码电路大幅度降低了标签芯片解码电路功耗,提高了标签响应灵敏度。
2022-03-22 21:29:38
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射频识别
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VHDL数字时钟课程设计
本资源包括 数字钟的基本工作原理、数字钟设计的电路原理图、VHDL设计程序
2022-03-22 19:04:01
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单片机
数字时钟
程序
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