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篮球竞赛30s
计数器
数字电子技术课程设计。本课程设计是脉冲数字电路的简单应用,设计了篮球竞赛30秒计时器。此计时器功能齐全,可以直接清零、启动、暂停和连续以及具有光电报警功能,同时应用了七段数码管来显示时间。此计时器有了启动、暂停和连续功能,可以方便地实现断点计时功能,当计时器递减到零时,会发出光电报警信号。本设计完成的中途计时功能,实现了在许多的特定场合进行时间追踪的功能,在社会生活中也具有广泛的应用价值。
2019-12-21 21:25:13
706KB
计数器
1
利用51单片机
计数器
测频率(最简程序)
网上的关于51
计数器
的程序很乱,大多数和其他的LCD什么的混在一起,而我的是最简单的,最直接的,而且注释很全,希望大家能够快速入门。
2019-12-21 21:15:09
159KB
51单片机,计数器,测频率
1
计数器
verilog 代码
eda简单的设计,本实例是一个16进制的
计数器
,适合入门者阅读!
2019-12-21 21:14:31
986KB
计数器
1
微机原理硬件实验报告(8255A并行接口应用、8253
计数器
定时器、串行口8251A)
详细的微机原理硬件实验报告,内容包括8255A并行接口应用、8253
计数器
定时器、串行口8251A,代码及结果、报告都是完整的。
2019-12-21 21:11:52
597KB
微机原理
8255A并行
8253计数
1
74LS160实现十二进制
计数器
数字逻辑设计 74LS160实现十二进制
计数器
2019-12-21 21:10:23
62KB
multism
8
实现
1
JK触发器 设计一个七进制
计数器
用JK触发器 设计一个七进制
计数器
,要求它能自启动。已知该
计数器
的状态转换图及状态编码
2019-12-21 21:03:08
33KB
DXP、JK
1
VHDL语言编写的十进制
计数器
和七段译码器
VHDL语言编写的十进制
计数器
和七段译码器,下来就知道了
2019-12-21 21:01:06
515B
VHDL
十进制计数器
七段译码器
1
FPGA十进制
计数器
的设计
FPGA实验,十进制
计数器
的设置。通过按键输出信号,采集脉冲信号后计数,并通过七段数码管显示
2019-12-21 20:57:15
278KB
FPGA
1
七进制
计数器
labview 的数字电路仿真,是7进制的
计数器
,用的是脉冲式触发的JK触发器组成的。
2019-12-21 20:54:16
40KB
labview
1
verilog 实现的0-9
计数器
数码管显示
verilog 0-9
计数器
数码管显示,在实验箱上进行过测试的!!
2019-12-21 20:54:12
951B
verilo
1
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