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CLK为时钟输入，RST为异步清零端，D[2..0]为模式控制端，可实现8种不同模式的计数方式，本计数器可供选择的计数模式分别为：七进制，十二进制，二十四进制，二十八进制，三十进制，三十一进制，六十进制，三百六十五进制。

2021-06-10 19:28:28 141KB 含异步清零和同步时钟的模可变计数器设计

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简易数字钟的EDA设计.txt

EDA作业简易数字钟的设计，有详细代码和流程图

2021-06-10 13:03:12 3KB EDA

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简易音乐播放器的EDA设计

EDA大作业简易音乐播放器的设计，有详细代码和流程图

2021-06-10 10:21:43 483KB EDA

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VHDL 4*4键盘扫描

通过了硬件测试，效果很好！解释：http://blog.csdn.net/qidaimengxing

2021-06-10 09:13:31 683KB VHDL EDA

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篮球记分器-EDA设计

EDA设计，软件使用的quartus ||

2021-06-09 20:39:18 569KB 篮球记分器、EDA设计、EDA

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quartus18.0编译仿真的七人表决器

利用quartus18.0软件编译仿真的七人表决器，含测试文件，供学习电子设计自动化（eda）的新人参考

2021-06-09 09:35:51 7.25MB eda 七人表决器 quartus

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EDA 8位10进制频率计数器【图形设计法+代码设计法】

EDA 8位10进制频率计数器【图形设计法+代码设计法】基于quartus II 的八位10进制计数器，共一个顶层文件和两个底层文件，有图形设计法和代码设计法，解压后直接打开工程文件即可。

2021-06-08 22:02:51 716KB EDA 频率计数器

数字频率计（EDA课程设计）实验方案报告

数字频率计（EDA课程设计）实验方案报告数字频率计 EDA课程设计用的和开发箱结合用的

2021-06-08 14:02:58 165KB 数字频率计 EDA课程设计

基于quartus的EDA八路抢答器电子设计

基于quartus的EDA八路抢答器电子设计包括原理图，实验报告注意事项，电路框图，流程图等

2021-06-08 11:06:42 1.33MB quartus EDA 八路抢答器

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eda 8位10进制频率计数器

基于quartus II 的八位10进制计数器，共一个顶层文件和两个底层文件，有图形设计法和代码设计法，解压后直接打开工程文件即可。

2021-06-08 09:48:46 728KB EDA 频率计 频率计数器

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