有关时序约束的文章,是一系列文章连载合集,xilinx的资料多一些,自己学习过程中整理的,看完能够完全掌握时序约束原理及操作技能,是很好的资料
2021-06-14 15:20:19 47.54MB fpga
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赛灵思 FPGA 设计时序约束指南,赛灵思 FPGA 设计时序 约束指南
2021-06-14 15:16:27 848KB xilinx FPGA 设计时序 约束指南
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文档详细叙述了常用时序分析SDC的命令参考.是Design Compiler使用中很好的参考资料。几乎囊括了DC始终的全部的常用指令!
2021-06-13 00:59:50 251KB 常用时序分析SDC 命令参考
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Local Bus是单板中最常用的总线,它既可以工作在同步方式下(如SDRAM),也可以工作在异步方式下,几乎每块单板都必须使用它。它的拓扑接口如图 1所示。
2021-06-11 18:02:40 631KB 驱动能力与时序
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FPGA altera 关于时序约束的详解手册,快速上手
2021-06-11 11:08:04 16.39MB FPGA altera 时序约束
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智能停车系统的UML图,时序图等等图的例子。使用的软件是starUML,附属文档,和图片,还有uml的源文件,适合本科大作业,可以二次修改。
2021-06-10 17:11:56 1.49MB StarUML 本科大作业 UML 时序图
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按i2c时序读写寄存器Read and write registers according to i2c timing
2021-06-10 10:58:48 3KB i2c
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单板信号质量与时序测试技术规范以信号完整性为依据,对单板信号质量与时序测试的方法、内容、注意事项等进行全面描述
2021-06-10 00:04:36 221KB 信号质量 时序测试
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该UML图包括HR系统的用例图,类图,时序图。而且类图是基于简单工厂模式所画,对很多初学UML的人来说很有帮助。
2021-06-09 14:27:00 341KB UML
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