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proteus基于8086最小模式下的硬件判优
抢答器
这个是微机原理的课程设计,一个独创硬件判断优先级的
抢答器
,其误差来源于锁存器的锁存时间,误差时间是脉冲信号在电路传递所需时间。从想法萌芽到具体的代码和硬件实现历时一周。比一般的软件轮询和,中断判断方式快的多。
2019-12-21 20:49:57
31KB
proteus
电路设计
抢答器
汇编
1
十路智力竞赛
抢答器
设计
十路智力竞赛
抢答器
的课程设计,十路智力
抢答器
需设定限时回答的功能,利用AT89S51单片机及外围接口实现的抢答系统,利用单片机的定时器/计数器定时和记数的原理,将软、硬件有机地结合起来,使得系统能够正确地进行计时
2019-12-21 20:49:35
665KB
单片机
课程设计
1
基于51八路
抢答器
设计
基于51单片机的八路
抢答器
设计,包含论文,原理图,PCB图。
2019-12-21 20:48:34
3.87MB
51单片机
八路抢答器
论文
1
基于Z-Stack协议栈的抢答系统案例设计与实现代码
为提高素质或竞赛选拔,各行业经常举办智力、知识竞赛,由于其竞赛没有好的软件系统支持,大多依靠主持人发挥水平,选手和观众渴望的类似电视台的节目效果难以实现。尤其计分计时
抢答器
,价格动辄万元。《
抢答器
》就是简单利用计算机及网络设备等资源,通过软件来实现专业效果的竞赛系统。《
抢答器
》的最大优势是其价格只是电子
抢答器
的十分之一,而功能却任用户自由设置。它实现竞赛的成本低,便于组织,通用性好。
2019-12-21 20:47:18
41.1MB
Zigbee抢答器
1
北京大学 基于Multisim的八路
抢答器
的设计与仿真(源文件、代码、实验报告)
北京大学 基于Multisim的八路
抢答器
的设计与仿真(源文件、代码、实验报告) 北京大学 基于Multisim的八路
抢答器
的设计与仿真(源文件、代码、实验报告)
2019-12-21 20:46:21
522KB
Multisim
电子设计
八路抢答器
数字电路
1
兰州大学 接口与通讯 微机实验代码及实验报告(流水灯,计算器,交通灯,频闪控制,
抢答器
,声控灯)
兰州大学 接口实验代码及实验报告(流水灯,计算器,交通灯,频闪控制,
抢答器
,声控灯)
2019-12-21 20:46:21
151KB
课程设计
流水灯
交通灯
声控灯
1
8路
抢答器
proteus仿真
采用数字电路进行的proteus八路
抢答器
仿真;包含10秒倒计时,99计分,抢答报警功能。附PDF电路图。
2019-12-21 20:46:20
160KB
8路抢答器
1
数字逻辑课程设计四路
抢答器
Proteus设计DSN源文件
数字逻辑课程设计之四路
抢答器
的DSN源文件,包括抢答电路,计分电路,倒计时电路,抢答犯规电路,复位电路,注释清晰清晰明了
2019-12-21 20:44:35
234KB
数字逻辑
1
竞赛
抢答器
设计
中国矿业大学-硬件课程设计-------------竞赛
抢答器
设计
2019-12-21 20:39:58
1.23MB
竞赛抢答器
中国矿业大学
硬件报告
1
FPGA/Verilog四人
抢答器
1.设计用于竞赛抢答的四人
抢答器
。 (1)有多路抢答,抢答台数为4; (2)抢答开始后20秒倒计时,20秒倒计时后无人抢答显示超时,发出报警信号; (3)能显示超前抢答台号并显示犯规警报。 2.系统复位后进入抢答状态,当有一路抢答按键按下,该路抢答信号将其余各路抢答信号封锁,同时铃声响起,直至该路按键松开,显示该路抢答台号。 3.用Verilog HDL语言设计符合上述功能要求的四人
抢答器
,并用层次化设计方法设计该电路。
2019-12-21 20:38:42
23.92MB
Verilog
FPGA
抢答器
硬件编程
1
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