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FPGA uart协议
相关开发流程http://www.cnblogs.com/noticeable/p/7233666.html
2019-12-21 20:23:50
7.16MB
友晶SOC
1
FIFO IP核的调用及仿真
开发流程http://www.cnblogs.com/noticeable/p/7255971.html
2019-12-21 20:23:50
346KB
DE-SOC
1
soc设计全流程
soc设计全流程,包括绪论、流程、工具、系统、同步、综合、验证、可测试性、低功耗、后端、集成等
2019-12-21 20:21:05
12.89MB
soc设计
1
基于小型Zynq SoC硬件加速的改进TINY YOLO实时车辆检测算法实现
针对TINY YOLO车辆检测算法计算量过大,且在小型嵌入式系统中难以达到实时检测要求的问题。利用小型Zynq SoC系统的架构优势以及TINY YOLO的网络权值中存在大量接近零的权值参数这一特点,提出硬件并行加速的改进算法,称为浓缩小型深度网络(Xerantic-TINY YOLO,X-TINY YOLO)车辆检测算
2019-12-21 20:19:45
1.22MB
车辆检测算法
1
蜂鸟SOC开源工程源码(基于 risc_v)
蜂鸟SOC开源工程源码是基于RISC-V架构的一个项目,RISC-V是一种开放源代码指令集架构(ISA),由加州大学伯克利分校的研究人员设计,并在全球范围内获得了广泛的关注和支持。RISC-V的设计理念是简化、高效和可扩展,这使得它在嵌入式系统、物联网(IoT)设备以及高性能计算等领域具有广泛应用前景。 这个项目的核心是为FPGA(Field-Programmable Gate Array)设计了一个完整的System-on-Chip (SOC)。FPGA是一种可编程的集成电路,允许开发者根据需要自定义硬件逻辑。Quartus II 13.1是Altera公司(现已被Intel收购)的一款强大的FPGA开发工具,它提供了从设计输入、逻辑综合、时序分析到配置芯片的全套流程,确保蜂鸟SOC能在目标FPGA上正确运行。 蜂鸟SOC源码的"rtl"目录可能包含以下关键组件: 1. **处理器核**:RISC-V的实现,通常包括RV32IMC指令集,支持整数运算、分支、内存访问等基本功能。 2. **内存控制器**:管理内部存储器,如SRAM,与处理器交互进行数据读写。 3. **外围接口**:如GPIO(通用输入/输出)、UART(通用异步接收发送器)等,用于连接外部设备。 4. **总线结构**:如AHB(Advanced High-performance Bus)或AXI(Advanced eXtensible Interface),用于在整个SOC内部协调不同模块的数据传输。 5. **中断控制器**:处理来自不同外设的中断请求,确保系统的实时响应。 6. **时钟和复位管理**:控制系统的时钟信号和复位操作,确保各部分正常工作。 7. **IP核**:可能包含预封装的功能模块,如加密、解码、浮点运算单元等,根据具体需求选择。 在Quartus II中,开发者首先会使用Verilog或VHDL等硬件描述语言编写源代码,然后通过综合工具将这些高级语言转化为门级网表,再经过布局布线生成最终的比特流文件,该文件可以直接烧录到FPGA中实现硬件功能。 在实际开发过程中,开发者需要进行以下步骤: 1. **设计输入**:编写源代码,定义SOC的各个模块和接口。 2. **编译和综合**:使用Quartus II的编译工具,将源代码转换成逻辑门级别的网表。 3. **时序分析**:检查设计是否满足速度和功耗要求,对设计进行优化。 4. **适配和布局布线**:将逻辑门网表映射到具体的FPGA资源上。 5. **仿真验证**:通过硬件描述语言或系统级仿真工具验证设计的功能和性能。 6. **编程和调试**:将生成的比特流文件下载到FPGA,进行硬件测试和调试。 通过这个开源项目,开发者可以学习到RISC-V处理器的设计原理,了解FPGA开发流程,以及如何构建一个完整的SOC系统。同时,这也是一个很好的实践平台,可以让开发者根据自己的需求定制和扩展硬件功能,进一步提升其在嵌入式系统和FPGA设计领域的专业技能。
2019-12-21 20:18:27
29.65MB
cpu
risc-v
fpga
1
卡尔曼SOC算法源代码
基于卡尔曼的电池SOC算法源代码实现过程,可以自由改写。
2019-12-21 20:12:37
17KB
卡尔曼
电池soc算法
1
Reuse Methodology Manual for System-On-A-Chip Designs - 3rd Edition
pdf版,相当不错的一个外文书,介绍SOC,建议有一定verilog经验,或做过相关东西后,再去读这本书,会有很深的启发,祝各位学习进步!
2019-12-21 20:07:21
6.42MB
SOC
verilog
reuse
硬件
1
ARM SoC体系结构(中文版).pdf
介绍了一般微处理器核的设计原理、基于微处理器核的SoC设计的基本概念和方法,通过对ARM系列处理器核和CPU核的详尽描述,来说明微处理器及外围接口的设计原理和方法。同时也综述了ARM系列处理器核和最新ARM核的研发成果,以及ARM和Thumb编程模型,对SoC设计中涉及到的存储器层次、Cache、存储器管理、片上总线、片上调试和产品测试等主要问题进行了论述。在此基础上给出了几个基于ARM核的SoC嵌入式应用的实例。最后对基于异步设计的ARM核AMULET及异步SoC子系统AMULET3H的研究进行了介绍。 本书的特点是将基于ARM微处理器核的SoC设计和实际嵌入式系统的应用集成于一体,对于基于ARM核的SoC设计和嵌入式系统开发者来说是一本很好的参考手册。可用作计算机科学技术与应用、电气工程、电子科学与技术专业本科生及硕士研究生的教材。也可作为从事集成电路设计的工程技术人员、基于ARM的嵌入式系统应用开发技术人员的参考书。
2019-12-21 20:05:26
9.17MB
ARM
体系结构
1
华为海思 HI3516A Soc datasheet
华为海思 HI3516A Soc datasheet,附件为中文版本,需要关注底层驱动的朋友学习,研究。
2019-12-21 20:02:59
20.37MB
芯片
SOC
1
Hi3518EV20X/Hi3516CV200经济型HD IP Camera Soc用户指南.pdf
Hi3518EV20X/Hi3516CV200经济型HD IP Camera Soc用户指南.pdf
2019-12-21 19:58:17
26.44MB
Hi3518EV20X
Hi3516CV200
Camera
Soc
1
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