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ASIC 设计理论与实践——RTL 验证、综合与版图设计

0.引言 　　大四保研到实验室正好碰到师兄师姐们找工作，听到的一些面试常问的内容就是“跨时钟域”、”异步处理“、”异步FIFO“等。然而我看的一些经典的书籍都是这样说的”异步电路很难设计，全部使用同步技术进行设计，所有寄存器器使用一个全局时钟驱动“。可在实际项目中，我又发现现代芯片设计中很难只使用一个时钟，时钟分频逻辑、时钟选择多路器，除了多时钟，有时还必须在两个不同的时钟间传递数据。也就是异步电路处理问题（两个没有特定关系的时钟传递数据被认为是异步的）。”异步电路很复杂“会有很多设计的不确定性。 　　1.亚稳态 　　时序逻辑中大量使用D触发器，D触发器的一般结构是：两个串联的反相器加两

数字IC设计工程师笔试面试经典100题(大部分有答案).pdf

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瑞芯微2022年秋招数字IC设计笔试题

思远半导体2022春招模拟IC笔试题，做电源的，据说还不错，题目中规中矩，还是非常不错的，找模拟IC工作的可以参考，一般都是这种形式，网络做题，拍照片上传，祝愿大家都能找到理想的工作。