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计算机组成原理实验，奇偶校验—学长的遗产

Verilog、流水线、TinyMIPS、仿真、异常、华莱士乘法器、除法器、协处理器。

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本实训项目将帮助学生掌握 CPU 控制器设计的基本原理，能利用硬布线控制器的设计原理在 Logisim 平台中设计实现支持五条指令的 MIPS 单周期 CPU，该处理器能运行简单的内存冒泡排序程序。能利用硬布线控制器以及微程序控制器的原理设计实现 MIPS 多周期 CPU。 第1关：单周期MIPS CPU设计.txt 第2关：微程序地址转移逻辑设计.txt 第3关：MIPS微程序CPU设计.txt 第4关：硬布线控制器状态机设计.txt 第5关：多周期MIPS硬布线控制器CPU设计（排序程序）.txt 存储器第七关.txt HUST1.txt 以下内容因还在构建中，还请谅解…… 第6关：单周期CPU单级中断机制设计(构建中) 第7关：单周期CPU多级中断机制设计---硬件堆栈(构建中) 第8关：单周期CPU多级中断机制设计---内存堆栈(构建中)