本示例实现了利用系统权限实现手机重启的功能,有关本示例的具体实现与生成系统签名的方法详见博文:http://blog.csdn.net/l1028386804/article/details/47687027
2021-07-20 14:37:03 1.41MB Android 签名
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C#开发实例1200例,PDF类型书籍1+2,外加源码和视频
2021-05-13 18:07:54 213B C#开发实例
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- 学习语音识别——以食物声音为例
2021-05-10 17:58:06 3KB
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Matlab精彩编程100例源码,100个例子的代码,每个实例都带有演示截图,代码中带有注释,非常适合拿去学习研究,推荐给想学习Matlab的朋友参考。
2021-05-06 11:12:39 3.89MB 其它源码-Matlab
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OPC UA方式从SINUMERIK 828D & 840D sl读写、监测参数数据,支持Sinumerik Operate 4.5 sp3的匿名登录和Sinumerik Operate 4.7的实名登录。源码环境为VS2017,C#
2021-04-10 17:04:05 1.71MB 源码 OPCUA SIEMENS SINUMERIK828D
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经典100例C源程序.经典C语言程序100例源码
2021-04-10 16:03:36 10.64MB c c语言
包含了比较容易的18个游戏,适合新手参考
2021-03-27 11:20:12 36.06MB FLASH AS3.0 小游戏 源码
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NXP LPC2214单片机软件参考设计基础例程30例源码,如下包括: Adc Adc01_c BeepCon_C DataRet_c disptimer2 emc Gpio I2c I2cInt_c IAP Idle_time LedDisp_c Pdrun_c power PWM Pwmdac_c ReMap RTC SendRtc_C SendStr_c SPI SpiDisp_C Time TIMEBEEP_C TIMEOUT_C UART VIC Wdt Wdtrun_c WR_e2prom
《 Verilog HDL 程序设计教程》135例; 。【例 3.1】4 位全加器 【例 3.2】4 位计数器 【例 3.3】4 位全加器的仿真程序 【例 3.4】4 位计数器的仿真程序 【例 3.5】“与-或-非”门电路 【例 5.1】用 case语句描述的 4 选 1 数据选择器 【例 5.2】同步置数、同步清零的计数器 【例 5.4】用 initial过程语句对测试变量 A、B、C 赋值 【例 5.5】用 begin-end 串行块产生信号波形 【例 5.6】用 fork-join 并行块产生信号波形 【例 5.7】持续赋值方式定义的 2 选 1 多路选择器 【例 5.8】阻塞赋值方式定义的 2 选 1 多路选择器 【例 5.9】非阻塞赋值【例 5.10】阻塞赋值 【例 5.11】模为 60 的 BCD码加法计数器 【例 5.12】BCD码—七段数码管显示译码器【例 5.13】用 casez 描述的数据选择器 【例 5.15】用 for 语句描述的七人投票表决器 【例 5.16】用 for 语句实现 2 个 8 位数相乘 【例 5.17】用 repeat 实现 8 位二进制数的乘法 【例 5.18】同一循环的不同实现方式 【例 5.19】使用了`include 语句的 16 位加法器 【例 5.20】条件编译举例【例 6.1】加法计数器中的进程 【例 6.2】任务举例【例 6.3】测试程序 【例 6.4】函数 【例 6.5】用函数和 case语句描述的编码器(不含优先顺序) 【例 6.6】阶乘运算函数 【例 6.7】测试程序 【例 6.8】顺序执行模块 1 【例 6.9】顺序执行模块 2 【例 6.10】并行执行模块 1 【例 6.11】并行执行模块 2 【例 7.1】调用门元件实现的 4 选 1 MUX 【例 7.2】用 case语句描述的 4 选 1 MUX 【例 7.3】行为描述方式实现的 4 位计数器 【例 7.4】数据流方式描述的 4 选 1 MUX 【例 7.5】用条件运算符描述的 4 选 1 MUX 【例 7.6】门级结构描述的 2 选 1MUX 【例 7.7】行为描述的 2 选 1MUX 【例 7.8】数据流描述的 2 选 1MUX 【例 7.9】调用门元件实现的 1 位半加器 【例 7.10】数据流方式描述的 1 位半加器 【例 7.11】采用行为描述的 1 位半加器 【例 7.12】采用行为描述的 1 位半加器 【例 7.13】调用门元件实现的 1 位全加器 【例 7.14】数据流描述的 1 位全加器 【例 7.15】1 位全加器【例 7.16】行为描述的 1 位全加器 【例 7.17】混合描述的 1 位全加器 【例 7.18】结构描述的 4 位级连全加器 【例 7.19】数据流描述的 4 位全加器 【例 7.20】行为描述的 4 位全加器 【例 8.1】$time 与$realtime 的区别 【例 8.2】$random 函数的使用 【例 8.3】1 位全加器进位输出 UDP 元件 【例 8.4】包含 x 态输入的 1 位全加器进位输出 UDP 元件 【例 8.5】用简缩符“?”表述的 1 位全加器进位输出 UDP 元件 【例 8.6】3 选 1 多路选择器 UDP 元件 【例 8.7】电平敏感的 1 位数据锁存器 UDP 元件 【例 8.8】上升沿触发的 D 触发器 UDP 元件 【例 8.9】带异步置 1 和异步清零的上升沿触发的 D 触发器 UDP 元件【例 8.12】延迟定义块举例 【例 8.13】激励波形的描述 【例 8.15】用 always 过程块产生两个时钟信号 【例 8.17】存储器在仿真程序中的应用 【例 8.18】8 位乘法器的仿真程序 【例 8.19】8 位加法器的仿真程序 【例 8.20】2 选 1 多路选择器的仿真 【例 8.21】8 位计数器的仿真 【例 9.1】基本门电路的几种描述方法【例 9.2】用 bufif1 关键字描述的三态门 【例 9.3】用 assign 语句描述的三态门 【例 9.4】三态双向驱动器 【例 9.5】三态双向驱动器 【例 9.6】3-8 译码器 【例 9.7】8-3 优先编码器 【例 9.8】用函数定义的 8-3 优先编码器 【例 9.9】七段数码管译码器 【例 9.10】奇偶校验位产生器 【例 9.11】用 if-else语句描述的 4 选 1 MUX 【例 9.12】用 case语句描述的 4 选 1 MUX 【例 9.13】用组合电路实现的 ROM 【例 9.14】基本 D 触发器 【例 9.15】带异步清 0、异步置 1 的 D 触发器 【例 9.16】带同步清 0、同步置
2021-03-11 15:53:48 127KB Verilog 教程 源码 FPGA
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TacitusLogger.DI.MicrosoftDI Microsoft依赖项注入容器的扩展,可帮助将TacitusLogger配置和添加为单例。 依存关系: NET标准> = 1.3 Microsoft.Extensions.DependencyInjection> = 1.0.0 TacitusLogger> = 0.3.0 注意: TacitusLogger.DI.MicrosoftDI当前处于Alpha阶段。 这意味着您不应在任何生产代码中使用它。 安装 NuGet: PM > Install-Package TacitusLogger.DI.MicrosoftDI 例子 在DI容器中注册记录仪 IServiceCollection serviceCollection = new ServiceCollection (); // Registering Tacit
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