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广工eda实验报告.zip

广工eda实验报告，包含源码、完整实验报告

2021-01-28 02:00:27 228.8MB 广工 数字逻辑与电子技术 实验报告

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广工eda实验报告和代码

广工eda实验报告以及代码

2020-01-05 03:12:56 2.78MB eda实验

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EDA实验报告_时序逻辑电路_组合逻辑电路

EDA实验报告第一次_时序逻辑电路的VHDL设计_组合逻辑电路的VHDL设计.docEDA实验报告第一次_时序逻辑电路的VHDL设计_组合逻辑电路的VHDL设计.doc

2020-01-03 11:43:53 236KB EDA VHDL verlog FPGA CPLD

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EDA实验报告异步清除十进制加法计数器的设计

异步清除是指复位信号有效时，直接将计数器的状态清零。在本设计中，复位信号为clr，低电平有效；时钟信号时clk，上升沿是有效边沿。在clr清除信号无效的的前提下，当clk的上升沿到来时，如果计数器原态是9（“1001”），计数器回到0（“0000”）态，否则计数器的状态将加1。

2020-01-03 11:42:14 102KB 采用文本输入法设计异步清除十进制加法计数器。

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EDA实验报告

eda课程实验与总结

2020-01-03 11:28:13 162B eda

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数字系统设计实验报告EDA技术

数字系统设计实验报告，中国矿业大学，计算机学院，

2020-01-03 11:20:43 1.97MB 数字系统设计 EDA 实验报告

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广工EDA实验报告（基于Libero）

广东工业大学数字逻辑基于Libero的实验，全部代码亲自测试都正确，有截图。

2019-12-21 19:42:07 1.53MB 数字逻辑实验 Libero EDA 广工

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