十六进制分水岭 HexWatershed是基于六边形网格框架的水文路径模型。 建造 有关详细信息,请参阅安装文档。 用法 请参考示例文档以获取详细信息。 文献资料 有关完整文档,请访问: : 致谢 该存储库中描述的模型由以下人员支持 西北太平洋国家实验室的实验室指导研究与开发(LDRD)计划快速入门项目。 作为多计划协作式综合沿海建模(ICoM)项目的一部分,美国能源部科学办公室,生物与环境研究办公室的地球系统模型开发以及区域和全球建模与分析计划领域。 美国能源部科学和生物研究办公室通过“地球与环境系统建模”计划作为“能源亿亿级地球系统模型(E3SM)”项目的一部分。 这项研究的一部分是使用太平洋西北国家实验室的PNNL研究计算进行的。 PNNL由Battelle Memorial Institute按照DE-AC05-76RL01830的合同为DOE经营。 引文 Liao
2022-08-30 16:08:15 29.56MB C++
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通过Unity编辑器扩展的方式 实现Astart寻路地图数据的可视化编辑,将地图数据导出为位图
2022-08-30 09:06:50 18KB Astart寻路
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Keil程序。修改数值即可移相任意角度,适用于移相全桥以及交错并联半桥所需的移相PWM。共输出3路互相移相的PWM,移相角可随意配置。高级定时器未使用,可以配置一路互补带死区PWM
2022-08-29 20:39:51 5.79MB stm32 arm 嵌入式硬件 单片机
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2022-08-28 09:04:21 58.69MB git github gitlab
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2022-08-28 09:04:20 28.23MB git github gitlab
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本设计是一个低相位噪声转换环路频率合成器 (也称为偏移环路)参考设计。这款转换环路频率合成器电路板主要包括ADF4002 合成器、AD8065 运算放大器、HMC512 压控振荡器 (VCO) 和超低噪声低压差稳压器 (LDO)。此电路将ADF4002锁相环 (PLL) 的较 低 100 MHz 参考频率转换到 5.0 GHz 至 5.4 GHz 的较高频 率范围,后一频率由本振 (LO) 频率决定。 与仅采用 PLL 的频率合成器相比,转换环路频率合成器的相位噪声非常低 (<50 fs)。 转换环路频率合成器系统组成框图: 相位噪声之所以很低,是因为 ADF4002整数 N 分频 PLL 使用的 N 值非常低,该 N 值用 于控制压控振荡器 (VCO)。本例中,ADF4002鉴频鉴相器 (PFD) 运行频率为 100 MHz,N = 1,所产生的相位噪声性 能不受 PLL 的 N 值限制。 用到器件参数说明: ADL5801:高IP3、10 MHz至6 GHz有源混频器 HMC512:集成Fo/2和4分频SMT的VCO,9.6 GHz至10.8 GHz ADF4355-2:集成 VCO 的微波宽 带频率合成器Integrated VCO AD8065 :高性能、145 MHz FastFET运算放大器 ADP151:超低噪声、200 mA CMOS线性调节器 ADM7150:800 mA、超低噪声、高PSRR、RF线性稳压器 ADF4002 :鉴相器/PLL频率合成器 附件内容截图:
2022-08-27 20:47:39 2.5MB 频率合成器 adf4002 电路方案
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系统分析师之路
2022-08-25 11:09:14 1.8MB 系统分析师之路
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