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基于Multisim的
计数器
设计仿真
计数器
是常用的时序逻辑电路器件,文中介绍了以四位同步二进制集成
计数器
74LS161和异步二-五-十模值
计数器
74LS290为主要芯片,设计实现了任意模值
计数器
电路,并用Multisim软件进行了仿真。仿真验证了设计的正确性和可靠性,设计与仿真结果表明,中规模集成
计数器
可有效实现任意模值计数功能,并且虚拟仿真为电子电路的设计与开发提高了效率。
2021-10-17 20:44:02
1.27MB
计数器;
Multisim;
模值;
仿真
1
Basys 板子Verilog FPGA 秒表
计数器
分频 数码管显示
Basys 板子Verilog FPGA 秒表
计数器
分频 数码管显示
2021-10-17 16:15:08
2KB
FPGA
Basys
Verilog
秒表
1
动态数码管实现
计数器
.zip
动态数码管实现简单单按键两位
计数器
2021-10-15 13:01:46
92KB
单片机
c
1
STM32CUEB关于KEIL5、stm32f103c8t6的encoder编码器检测、霍尔
计数器
程序控制
STM32CUEB关于KEIL5、stm32f103c8t6的encoder编码器检测、霍尔
计数器
程序控制
2021-10-14 18:52:58
4.1MB
STM32CUEB
KEIL5
stm32f103c8t6
encoder编码器检测
1
数电实验-十六进制同步
计数器
.ms14
数电实验-十六进制同步
计数器
.ms14
2021-10-14 13:03:09
168KB
西科
数电
基于单片机的
计数器
设计
c语言的,51单片机的应用。
计数器
从1计数到99,再重复计数。
2021-10-14 10:16:52
317KB
单片机
计数器
1
模16加减可逆
计数器
(有限状态机版本).docx
老师布置的作业,通过一段时间的学习,自己写的模16加减可逆
计数器
,看到很多人是直接写的,这里给一个用有限状态机写的,希望对大家有所帮助。
2021-10-14 09:05:45
130KB
FPGA
Verilog
HDL
1
verilog加减法置数
计数器
verilog硬件描述加减法可置数
计数器
2021-10-10 16:56:25
31KB
verilog
计数器
1
基于51单片机的数字频率
计数器
任务书
通过设计基于51单片机的数字频率
计数器
,要求实现对于不同频率的各类信号进行频率测量。本课题要求设计数字频率
计数器
的硬件电路和相应的软件程序,并相互配合完成指定的功能与指标。
2021-10-09 20:58:56
14KB
51单片机
数字频率计
1
篮球竞赛24秒
计数器
设计报告(论文).pdf
篮球竞赛24秒
计数器
设计报告(论文).pdf
2021-10-09 15:01:58
406KB
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