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三相数字
锁相
环pscad仿真
三相数字
锁相
环pscad仿真 采用dq变换 PI控制
2021-05-19 15:52:57
24KB
pscad
锁相环
1
ADF4351文件
这是ADF4351画好的PCB成品,有需要的可以下载。
2021-05-18 13:48:04
4.66MB
ADF4351
锁相环
PLL
1
三相
锁相
环SRF-PLL.zip
搭建的是SRF-PLL
锁相
环simulink仿真,实现了三相平衡情况下的稳态响应和暂态响应(电压跌落,相位突变),还有三相不平衡情况下的暂态响应,并对SRF-PLL工作原理进行了一定的分析。 内含mdl文件和m文件,压缩在一起了。m文件是画结果的波形图,可以自己添加到model properties下的StopFcn里面,把文件名字写在里面,这里m文件名字是plot_output,就输入plot_output;即可。 仿真是是用2016b做的,需要低版本的可以留言
2021-05-17 16:51:56
215KB
SRF-PLL
锁相环
matlab仿真
单同步锁相环
1
双二阶广义积分器(SOGI)软件
锁相
(基于双线性变换)代码.txt
该函数在PWM中断中周期性的调用,输入是采集到的三相电压alpha,belta坐标下的分量, 输出是正序电压在alpha,belta坐标下的分量,利用这个输出量进行单同步软件
锁相
即可。 该代码在三相380VAC输入的30KW单位功率因数整流器中获得良好的应用。 如果没有相当电力电子方面的软件工程经验,这个代码不容易看懂,里面涉及传递函数,及传递函数的离散化,离散后的代码化,对于新手来说,搜集这方面的资料并且搞懂,不容易。如果需要讲解,私信我。我可以提供有偿讲解
2021-05-15 19:41:29
2KB
PLL锁相代码
并网软件锁相
1
数字
锁相
环设计源程序
数字
锁相
环设计源程序, PLL是数字
锁相
环设计源程序, 其中, Fi是输入频率(接收数据), Fo(Q5)是本地输出频率. 目的是从输入数据中提取时钟信号(Q5), 其频率与数据速率一致, 时钟上升沿锁定在数据的上升和下降沿上; 顶层文件是PLL.GDF
2021-05-15 17:48:12
118KB
数字锁相环设计源程序
1
基于
锁相
环的调制解调与MATLAB仿真实现
基于
锁相
环的调制解调与MATLAB仿真实现
2021-05-15 09:07:02
1.42MB
锁相环
调制解调
基于multisim的
锁相
环仿真
在multisim中未集成pll的仿真模块,本文提供了在multisim中模拟pll的方法
2021-05-14 15:21:50
141KB
multisim
锁相环
pll
1
verilog语言的FPGA数字
锁相
环PLL实现
使用verilog语言实现的FPGA数字
锁相
环(pll)
2021-05-14 15:16:26
198KB
verilog
fpga
pll
1
锁相
环(PLL)原理
一个典型的
锁相
环(PLL)系统,是由鉴相器(PD),压控荡器(VCO)和低通滤波器(LPF)三个基本电路组成
2021-05-14 15:06:15
293KB
锁相环
1
最全面最权威的
锁相
环PLL原理与应用资料
最全面最权威的
锁相
环PLL原理与应用资料 包括1:
锁相
技术__张厥盛(西安电子科大出版) 2:
锁相
环PLL电路设计与应用(日)远坂俊昭著 这是PLL经典资料包括大量应用实例 3:Design Technique for Charge Pump Phase-Locked Loops 英文资料包括PLL设计详细步骤,对英文底子好的非常有用啊 4:一个非常有用的
锁相
环滤波器设计软件(绿色版) 以上资料包括了
锁相
环原理与应用的所有方面,每一份都值得仔细研究,大家无需再下载任何PLL资料了。
2021-05-14 15:00:01
19.9MB
锁相环
PLL
滤波器
原理
1
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