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简易数字频率计

①能够测试10Hz~10MHz方波信号； ②电路输入的基准时钟为1Hz，要求测量值以8421BCD码形式输出； ③系统有复位键； ④采用分层次分模块的方法，用Verilog HDL进行设计

2021-07-11 12:32:52 4KB verilog

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一个频率计程序exti_f1_c8t6.zip

没有电路图只有代码，有一点问题，仅供参考。pwm产生，中断计数

2021-07-10 11:12:45 7.26MB 频率计 stm32

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基于STM32的频率计+仿真.rar

采用捕获上升沿计数换算频率。信号源为脉冲，使用proteus自带信号源产生。

2021-07-10 09:04:27 4.87MB 嵌入式 频率计 stm32 proteus

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看清楚没有proteus仿真。

2021-07-10 09:04:27 19.17MB stm32 频率计 PCB

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基于FPGA 的数字频率计设计

这是一份基于FPGA的数字频率计的设计，用到了verilog 语言，通过检测波形的高低电平来计算出该波形的频率大小并显示在数码管上。

2021-07-10 00:43:07 1.61MB FPGA Verilog 频率计

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EDA课程设计数字时钟

EDA课程设计课题1：数字钟设计设计要求： 1. 具有时、分、秒，计数及数码管显示功能，以 24 小时循环计时。 2. 具有清零，调节小时、分钟功能

2021-07-09 16:19:11 715KB EDA 数字时钟 数字频率计

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北邮数字逻辑课程设计频率计

北邮小学期数字逻辑课程设计之频率计的实现。

2021-07-08 22:00:52 297KB 频率计 北邮 数字逻辑

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EDA数字频率计综合设计

基于Quartus II 6.1 (32-Bit)设计VHDL语言数字频率计综合设计（结合数码管显示）

2021-07-08 18:13:16 16KB 数字频率计 EDA

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EDA课程设计数字频率计设计

整套的EDA课程设计数字频率计设计，物有所值

2021-07-08 18:05:35 254KB 数字频率计

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QUARTUS 频率计

QUARTUS频率计-数字系统设计的实验报告

2021-07-07 19:11:26 391KB 频率计 QUARTUS

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