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基于FPGA的数字时钟实现

基于FPGA的数字时钟实现：有校时、闹钟响铃等功能。用开发板具体功能可实现。开发板型号ALINX

2021-03-06 20:03:57 4.29MB FPGA 数字时钟 verilog

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FPGA数字时钟（含闹钟）

6位数字时钟，verilog实现，方便移植，含闹钟设置，代码中闹钟部分以led闪烁表示，可修改，欢迎提问

2020-12-10 12:55:28 2.39MB 闹钟时钟 verilog Quartus

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FPGA 数字时钟

基于verilog的FPGA数字时钟，如果安装了ISE可以直接打开.xise文件下载到FPGA板上，否则可以找文件夹中的.v文件使用

2020-01-03 11:26:53 795KB FPGA Verilog ISE 数字时钟

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基于FPGA的数字时钟（可调时）BASYS2（绝对有用）

基于FPGA的数字时钟（可调时），切换显示模式，BASYS2

2019-12-21 21:33:03 9KB FPGA 数字时钟 BASYS2

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