VerilogHDL扫盲文 VerilogHDL那些事儿_建模篇(vivado) Verilog_HDL_那些事儿_时序篇(verilog modelsim) VerilogHDL那些事儿-整合篇
2019-12-21 20:34:23 62.14MB FPGA
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基于Verilog HDL的数字系统应用设计,西安电子科技大学出版社。非影印版。
2019-12-21 20:22:35 18.66MB VerilogHDL
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用verilog语言编写的补码加减法器,其中三位数值为,一位符号位。
2019-12-21 20:19:21 606B 补码四位加减法器,verilogHDL
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VerilogHDL高级数字设计课后答案--Michael_D.Ciletti,课后习题答案,比较实用。
2019-12-21 20:16:56 1.36MB Verilog HDL 高级设计 课后答案
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EDA技术实用教程-VerilogHDL版(第四版)课件-潘松
2019-12-21 20:01:49 24.74MB verilog EDA ppt
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VerilogHDL那些事-整合篇是VerilogHDL那些事儿-建模篇与VerilogHDL那些事儿-时序篇的姊妹篇,可以一起看看,初学必备
2019-12-21 19:53:06 15.19MB FPGA 整合
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本书从用户的角度全面阐述了Verilog HDL语言的重要细节和基本设计方法,并详细介绍了Verilog 2001版的主要改进部分。本书重点关注如何应用Verilog语言进行数字电路和系统的设计和验证,而不仅仅讲解语法。全书从基本概念讲起,并逐渐过渡到编程语言接口以及逻辑综合等高级主题。书中的内容全部符合Verilog HDL IEEE 1364-2001标准。
2019-12-21 19:46:06 13.46MB FPGA Verilog
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基于VerilogHDL的FIR数字滤波器设计与仿真
2019-12-21 19:38:51 97KB FIR滤波器
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aes128位数据加密算法源码,有veriolg硬件描述语言写的
2019-12-21 19:34:52 13.32MB aes、veriolg
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本代码采用verilogHDL编写,实现的是数字跑表功能
2019-12-21 19:23:53 153KB verilogHDL 数字跑表
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