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基于MIG的DDR3读写测试电路Vivado工程已上板测试
自己编写的基于MIG IP核的针对DDR3的读写测试电路,非自带的示例工程,可用于快速熟悉MIG用户接口的时序关系及使用方法。压缩包内为Vivado工程,已成功上板调试。附带testbench,tb里包含有DDR3仿真模型及wiredelay模块的使用方法,仅供参考。
2019-12-26 03:03:33
69.07MB
MIG
DDR3
FPGA
1
详细介绍 DDR3基础知识、参数、命令、时序等
详细介绍 DDR3基础知识、参数、命令、时序等
2019-12-21 22:24:59
495KB
DDR3
参数
时序
1
DDR3 sodimm DXP封装
通用笔记本DDR3 204引脚 sodimm DXP封装库。
2019-12-21 22:17:25
4.28MB
DDR3
SODIMM
204脚
1
内存SPD文件打包,SDR,DDR,DDR2,DDR3都有
各种内存SPD文件打包,SDR,DDR,DDR2,DDR3都有合计300多个,需要的朋友可以下载.
2019-12-21 22:15:24
69KB
SPD文件
DDR2
DDR3
DDR
1
JESD标准规范(DDR3&DDR4标准规范)
压缩文件中包含了JESD标准规范中的JESD79-3F(DDR3标准规范)和JESD79-4A(DDR4标准规范),对于深入了解DDR3和DDR4有一定参考价值。
2019-12-21 22:14:57
6.5MB
DDR3&DDR4
1
DDR3实例 allegro
DDR3布线实例参考 allegro文件。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。
2019-12-21 21:33:08
979KB
DDR3实例
allegro
1
ddr3原理图和PCB(allegro)
ddr3的参考设计,pcb是allegro格式(.dra)
2019-12-21 21:18:08
2.2MB
DDR3
1
xilinx 7Series memory interface Generator 说明书
xilinx 7Series memory interface Generator 说明书,非常详细的。
2019-12-21 21:17:51
18.95MB
Xilinx
DDR3,DDR2
1
JESD79-3F.pdf
DDR3 最新 协议
2019-12-21 21:13:40
5.6MB
DDR3协议
1
三星K4B4G1646E.PDF
DS_K4B4G1646E-BC_Rev101-0
2019-12-21 20:57:38
1.73MB
三星DDR3
1
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