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基于MIG的DDR3读写测试电路Vivado工程已上板测试
基于MIG的DDR3读写测试电路Vivado工程已上板测试
上传者:
fubian4633
|
上传时间: 2019-12-26 03:03:33
|
文件大小: 69.07MB
|
文件类型: rar
MIG
DDR3
FPGA
自己编写的基于MIG IP核的针对DDR3的读写测试电路,非自带的示例工程,可用于快速熟悉MIG用户接口的时序关系及使用方法。压缩包内为Vivado工程,已成功上板调试。附带testbench,tb里包含有DDR3仿真模型及wiredelay模块的使用方法,仅供参考。
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