掌握内存管理的页面淘汰算法 输入可用内存页面数和一个作业访问逻辑页号的序列,分别给存FIFO、LRU算法的缺页中断率 LRU OPT FIFO
2021-11-01 21:29:19 7KB 页面置换算法三种
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页面置换算法(fifo,lru,opt) C语言编写 是我操作系统课程设计的题目,自己完成的
2021-11-01 21:09:29 59KB fifi lru opt
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【iCore3 双核心板_FPGA】实验二十:基于FIFO的ARM+FPGA数据存取实验-附件资源
2021-10-31 17:02:43 106B
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介绍了DDR SDRAM的接口时序,分析了其在系统中的位、功能和作用,在此基础上提出了设计方案规划。之后着重叙述了基于Stratix.II GX系列FPGA的DDR2接口的FIFO工程设计,对于主控核心单元、数据输入单元和数据缓存单元进行了单独的模块化分析,并且对主要模块进行了功能仿真,归纳问题。
2021-10-30 19:30:13 6.02MB DDR SDRAM, FPGA, FIFO
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OV7670摄像头 驱动代码 测试成功 提供摄像头OV7670(带FIFO AL422b)的驱动代码, 包括OV7670中文+英文数据手册+AL422b英文数据手册+摄像头使用说明.pdf+接口图.jpg+应用指南.pdf 很详细的资料 看懂了操作摄像头完全没压力!
2021-10-29 16:09:45 8.15MB OV7670 AL422b
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N皇后问题回溯法、FIFO分支限界算法,内部包含两个函数,在main函数中分别运行。
2021-10-26 09:36:18 3KB N皇后 回溯法 分支限界
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FIFO的verilog设计测试代码,可以根据需要修改设计参数满足你的需要,是学习和应用FPGA的好例子。
2021-10-25 20:08:33 62KB FIFO verilog
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fpga开发的一些例子以及技巧,包括时钟、复位、fifo、pingpong操作等
2021-10-25 13:01:34 3.41MB fpga开发
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CY7C68013读写FIFO源代码(Verilog).
2021-10-25 10:45:19 5KB CY7C68013 Verilog
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该资源是实现了的通过异步fifo进行跨时钟域传输的vivado工程,在不同的时钟域进行fifo数据读写,并用读写地址的格雷码判断fifo空满产生空满标志。工程代码基于vivado2017.4,并在modelsim10.6上仿真成功。工程中附有testbench。
2021-10-24 22:25:14 318KB 异步FIFO 跨时钟域 fpga基础 数字ic面试
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